鉴相算法
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查看全部 500 份 →一种低电压无死区鉴相器
一种高性能低电压无死区鉴频鉴相器 ( PF D )电路 ,并通过时钟分析优化其设计 参数 。 阐述了恢复时间对 PF D 电路最大工作频率的影响以及降低 PF D 恢复时间的设计方法 ,仿真 结果同理论极为相符 。
2026-03-01
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锁相环PLL算法
此文件是数字处理算法的一种,锁相环PLL算法,用来统一整合时脉讯号,使内存能正确的存取资料。PLL用于振荡器中的反馈技术。用C语言编写,可直接用于C开发的软件中。省去了自己按照原理编写程序的麻烦。
2023-04-22
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