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进制计数器 的查询结果
VHDL/Verilog/EDA源码 6进制计数器VHDL程序
6进制计数器VHDL程序
--文件名：counter6.vhd。
--功能：6进制计数器，有进位C
VHDL/Verilog/EDA源码 10进制计数器VHDL程序
10进制计数器VHDL程序
--文件名：counter10.vhd。
--功能：10进制计数器，有进位C
VHDL/Verilog/EDA源码 24进制计数器VHDL程序
24进制计数器VHDL程序
--文件名：counter24.vhd。
--功能：24进制计数器。
模拟电子 采用归零法的N进制计数器原理
计数器是一种重要的时序逻辑电路，广泛应用于各类数字系统中。介绍以集成计数器74LS161和74LS160为基础，用归零法设计N进制计数器的原理与步骤。用此方法设计了3种36进制计数器，并用Multisim10软件进行仿真。计算机仿真结果表明设计的计数器实现了36进制计数的功能。基于集成计数器的N进制计数器设计方法简单、可行，运用M ...
VHDL/FPGA/Verilog 电子时钟VHDL程序与仿真 10进制计数器设计与仿真 6进制计数器设计与仿真
电子时钟VHDL程序与仿真 10进制计数器设计与仿真 6进制计数器设计与仿真
VHDL/FPGA/Verilog 四进制计数器模块
四进制计数器模块，使用VHDL语言编写，在ISE8.1中经过测试的模型
VHDL/FPGA/Verilog 3-8译码器,BCD码转换10进制,计数器
3-8译码器,BCD码转换10进制,计数器
VHDL/FPGA/Verilog Quartus环境下的1000进制计数器的扫描显示电路
Quartus环境下的1000进制计数器的扫描显示电路
VHDL/FPGA/Verilog Quartus环境下的12进制计数器的扫描显示电路
Quartus环境下的12进制计数器的扫描显示电路
其他 同步计数器和异步计数器在设计时有哪些区别？试用 六进制计数器和一个十进制计数器构成一个六十进制同步计数器。
同步计数器和异步计数器在设计时有哪些区别？试用 六进制计数器和一个十进制计数器构成一个六十进制同步计数器。