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基于Xilinx FPGA ip核的使用实例
基于EP3C25的Altera SDI IP核的使用
这是CAN总线控制器的IP核,源码是由Verilog HDL编写的。其硬件结构与SJA1000类似,满足CAN2.0B协议。
经过仿真验证的MC8051IP核源码,用VHDL语言实现。
基于流水线方式的可重构AES算法的IP核实现,是传统方式的改良,性能更加优化
digilent提供的基于vivado的xilinx ip核,包含常用的hdmi解码ip等文件
资料->【C】嵌入系统->【C0】嵌入式综合->【4】单片机论文->硕士毕业论文->USB20设备接口IP核的设计.pdf
I2C器件接口IP核的CPLD设计,从原理到设计!
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