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VHDL语言描述，时钟分频,给定CPLD试验板系统时钟设置50M，但由于本作品的需要，我们将系统时钟经过20分频得到DS18B20所需的工作时钟，大约为1.25M。

2014-12-06 25 语言概述

讲述了Visual Basic6．0概述，Visual Basic6．0可视化开发环境概述，Visual Basic6．0简单程序设计，代码基础，基本控制结构，数组、枚举与甩户自定义类型，过程与程序调试，常用内部控件，程序界面设计，图形图像...

2014-01-27 151 语言概述