近年来，近距离无线传输技术是发展最快、最引入注目的技术，而ZigBee恰恰是填补了低速率无线通信技术的空缺，与其他标准在应用上相得益彰。它专注于近距离传输，成本低、同时入门槛也低，虽然其出现较晚，但目前已经得到人们越来越多的关注，成为无线技术研究的一个新热点。 本文在详细分析了传统的抄表方式和无线抄表系统的发展状况以及相关的无线数据传输技术的基础上，提出了基于ZigBee技术的无线抄表系统的方案。论文在研究ZigBee组网技术的基础上，设计了基于ZigBee开发平台的无线嵌入式抄表系统，编写了相应的软件，完成了相应的调试和分析，并进行了系统的可靠性、实时性和安全性等问题分析。为了减少系统由于节点路由而造成的功耗损耗过大的问题，本文在组网应用过程中采用Tree+AODVjr的路由算法，从而保持系统能够保持较小功耗的情况下进行数据的多跳路由，同时以ARM S3C2410为核心实现了基站设计，实现小区电表数据的集中采集，并通过GPRS/GSM模块实现基站和抄表中心的数据传输和实时控制，在此基础上，对抄表系统软件也进行了相应的设计。 通过单点对单点、星形网络数据传输实验，取得了相应的实验数据，对于协议的特点、系统可靠性和功耗情况有了整体把握，为今后ZigBee技术的进一步研究和应用打下了坚实基础。 实验结果显示，本文提出的方案切实可行，并且采用ZigBee技术具有节约资源、操作方便、可靠性高而且易于管理等特点，基站和系统利用较为成熟的GPRS/GSM网络技术进行通讯，既满足了实时性要求，又降低了成本。
上传时间： 2013-06-27
上传用户：kjgkadjg
我用此表计算变压器.表上的数据是我一个设计,效率达85%.我希望大家共同探讨它,完善它.
上传时间： 2013-07-15
上传用户：dba1592201
EC电磁学计算 电流 温度 线宽 过孔 承受电流
上传时间： 2013-04-24
上传用户：清风徐来吧
基于M S P 430单片机的数字电压表的设计设计电路图
上传时间： 2013-06-02
上传用户：FFAN
基于AT89C51单片机的数字电压表的设计
上传时间： 2013-07-10
上传用户：liglechongchong
单片机课程设计：采用51系列单片机和ADC设计一个数字电压表，输入为0～5V线性模拟信号，输出通过LED显示，要求显示两位小数。
标签： 数字电压表
上传时间： 2013-04-24
上传用户：快乐的小糗糗
完整的红外抄表系统 自己做过的项目 包括完整的程序和电路图,PCB板图 使用伟福编译器编译
上传时间： 2013-07-14
上传用户：lhw888
调整视频图像的分辨率需要视频缩放技术。如果图像缩放技术的处理速度达到实时性要求就可以应用于视频缩放。 传统图像缩放技术利用插值核函数对已有像素点进行插值重建还原图像。本文介绍了图像插值的理论基础一采样定理，并对理想重建函数Sinc函数进行了讨论。本文介绍了常用的线性图像插值技术及像素填充、自适应插值和小波域图像缩放等技术。然后，本文讨论了分级线性插值算法的思想，设计并实现了FPGA上的分级双三次算法。最后本文对各种算法的缩放效果进行了分析和讨论。 本文在分析现有视频缩放算法基础之上，提出了分级线性插值算法，并应用在简化线性插值算法中。分级线性插值算法以牺牲一定的计算精度为代价，用查找表代替乘法计算，降低了算法复杂度。本文设计并实现了分级双三次插值算法，详细说明了板上系统的模块结构。最后本文将分级线性插值算法与原线性插值算法效果图进行比较，比较结果显示分级插值算法与原算法误差较小，在放大比例较小时可以取代原算法。结果证明分级双三次线性插值算法的FPGA实现能够满足额定帧频，可以进行实时视频缩放。
上传时间： 2013-04-24
上传用户：亚亚娟娟123
MPEG-2是MPEG组织在1994年为了高级工业标准的图象质量以及更高的传输率所提出的视频编码标准，其优秀性使之成为过去十年应用最为广泛的标准，也是未来十年影响力最为广泛的标准之一。 本文以MPEG-2视频标准为研究内容，建立系统级设计方案，设计FPGA原型芯片，并在FPGA系统中验证视频解码芯片的功能。最后在0.18微米工艺下实现ASIC的前端设计。完成的主要工作包括以下几个方面： 1.完成解码系统的体系结构的设计，采用了自顶而下的设计方法，实现系统的功能单元的划分；根据其视频解码的特点，确定解码器的控制方式；把视频数据分文帧内数据和帧间数据，实现两种数据的并行解码。 2.实现了具体模块的设计：根据本文研究的要求，在比特流格式器模块设计中提出了特有的解码方式；在可变长模块中的变长数据解码采用组合逻辑外加查找表的方式实现，大大减少了变长数据解码的时间；IQ、IDCT模块采用流水的设计方法，减少数据计算的时间：运动补偿模块，针对模块数据运算量大和访问帧存储器频繁的特点，采用四个插值单元同时处理，增加像素缓冲器，充分利用并行性结构等方法来加快运动补偿速度。 3.根据视频解码的参考软件，通过解码系统的仿真结果和软件结果的比较来验证模块的功能正确性。最后用FPGA开发板实现了解码系统的原型芯片验证，取得了良好的解码效果。 整个设计采用Verilog HDL语言描述，通过了现场可编程门阵列(FPGA)的原型验证，并采用SIMC0.18μm工艺单元库完成了该电路的逻辑综合。经过实际视频码流测试，本文设计可以达到MPEG-2视频主类主级的实时解码的技术要求。
上传时间： 2013-07-27
上传用户：ice_qi
MP3音乐是目前最为流行的音乐格式，因其音质、复杂度与压缩比的完美折中，占据着广阔的市场，不仅在互联网上广为流传，而且在便携式设备领域深受人们喜爱。本文以MPEG-1的MP3音频解码器为研究对象，在实时性、面积等约束条件下，研究MP3解码电路的设计方法，实现FPGA原型芯片，研究MP3原型芯片的验证方法。 论文的主要贡献如下： (1)使用算法融合方法合并MP3解码过程的相关步骤，以减少缓冲区存储单元的容量和访存次数。如把重排序步骤融合到反量化模块，可以减少一半的读写RAM操作；把IMDCT模块内部的三个算法步骤融合在一起进行设计，可以省去存储中间计算结果的缓存区单元。 (2)反量化、立体声处理等模块中，采用流水线设计技术，设置寄存器把较长的组合逻辑路径隔开，提高了电路的性能和可靠性；使用连续访问公共缓存技术，合理规划各计算子模块的工作时序，将数据计算的时间隐藏在访存过程中；充分利用频率线的零值区特性，有效地减少数据计算量，加快了数据处理的速度。 (3)设计了MP3硬件解码器的FPGA原型芯片。采用Verilog HDL硬件描述语言设计RTL级电路，完成功能仿真，以Altera公司Stratix II系列的EP2S180 FPGA开发板为平台，实现MP3解码器的FPGA原型芯片。MP3硬件解码器在Stratix II EP2S180器件内的资源利用率约为5％，其中组合逻辑查找表ALUT为7189个，寄存器共有4024个，系统频率可达69.6MHz，充分满足了MP3解码过程的实时性要求。实验结果表明，MP3音频解码FPGA原型芯片可正常播放声音，解码音质良好。
上传时间： 2013-07-01
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