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VHDL数字钟设计程序 设计要求 基本要求： 1、24小时计数显示； 2、具有校时功能（时，分） ； 附加要求： 1、实现闹钟功能（定时，闹响）；
1.设计一个时间类（年、月、日、时、分）； 设计一个通知类，包含时间，地点和事件；其中时间用时间类的对象； 通知类中包含构造函数、输入通知和打印通知等功能函数。 在主程序中测试。 2.设计一个矩形类，数据成员是对角线上顶点。矩形类可...
数字显示当前的小时、分钟、秒； 2、可以预置为12小时计时显示和24小时计时显示； 3、一个调节键，用于调节目标数位的数字。对调节的内容敏感，如调节分钟或秒时，保持按下时自动计数，否则以脉冲计数； 4、一个功能键，用于切换不同状态：计...