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高级篇05 :基于FPGA的DUC数字上变频设计
高级篇06: 基于FPGA的DDC数字下变频设计
该算法实现了重叠频域数字滤波器的设计,该程序对信号在时域和频域应用了叠加和重迭保留技术
介绍了DDS(直接数字频率合成)芯片AD9852的工作原理、性能和在频率测量领域中利用AD9852设计出数字可控的频率源.
如何给时钟倍频或者分频,以及altera提供的IP核使用方法
一个分辩率达1Hz的2G频率计, mcs51单片几设计
fpga上实现的最小是0.5分频的任意分频器
三分频程序,对输入的时钟信号进行分频,在此基础上可以进行倍频和分频的转化。
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