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简单的数字频率计,source为输入,可以测量其频率,在maxplux中使用,需要标准的1hz时钟信号。
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简易数字频率计,verilog语言编写,使用于频率大于1hz的信号,基本无误差
基于MSP430F149简易数字频率计设计
个时频原子的模糊函数及理想时频分布;三个时频原子的理想时频分布
0到255任意整数半整数分频Verilog HDL.rar
VHDL三分频程序 VHDL三分频程序 VHDL三分频程序
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