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芯片通信

  • 超高频RFID读卡器设计及其通信.rar

    射频识别技术是一种自20 世纪80 年代新兴的自动识别技术。它是利用无线射频方式进行非接触双向数据通信。相对于普遍应用的13.56MHz 射频识别系统,本设计中的868MHz 射频识别系统有着更多的优点:读写距离远,阅读速度快等,是目前国际上RFID产品发展的热点。 本课题研究的内容包括研究符合ISO18000-6 标准的超高频RFID 电子标签的主要特点、结构、工作原理及读写方法, 重点在于与其相应读卡器的设计方案, 包括读卡器的硬件电路设计、软件程序流程以及与上位机通信的实现。 在硬件设计中,选用ATMEL 公司的AVR 单片机ATmega8 作为主控制器,设计了主控、复位、串行通信等电路。并以RFM 公司开发的TRC101 为射频收发芯片进行了射频收发模块的设计。 软件设计采用模块化编程和结构化编程的思想,单片机编程语言为汇编语言,与上位机串行通信采用Visual Basic 编程。经过测试,误码率较低,编制的防冲突程序实现了基于随机二进制算法的防冲突功能。 本设计具有可靠性高,模块化设计等特点,通过验证,满足标准要求,达到了预期的目的,并证明了本设计性能的稳定性和可靠性。

    标签: RFID 超高频 读卡器

    上传时间: 2013-04-24

    上传用户:shenlan

  • 超高频RFID读卡器设计及其通信.rar

    射频识别技术是一种自20 世纪80 年代新兴的自动识别技术。它是利用无线射频方式进行非接触双向数据通信。相对于普遍应用的13.56MHz 射频识别系统,本设计中的868MHz 射频识别系统有着更多的优点:读写距离远,阅读速度快等,是目前国际上RFID产品发展的热点。 本课题研究的内容包括研究符合ISO18000-6 标准的超高频RFID 电子标签的主要特点、结构、工作原理及读写方法, 重点在于与其相应读卡器的设计方案, 包括读卡器的硬件电路设计、软件程序流程以及与上位机通信的实现。 在硬件设计中,选用ATMEL 公司的AVR 单片机ATmega8 作为主控制器,设计了主控、复位、串行通信等电路。并以RFM 公司开发的TRC101 为射频收发芯片进行了射频收发模块的设计。 软件设计采用模块化编程和结构化编程的思想,单片机编程语言为汇编语言,与上位机串行通信采用Visual Basic 编程。经过测试,误码率较低,编制的防冲突程序实现了基于随机二进制算法的防冲突功能。 本设计具有可靠性高,模块化设计等特点,通过验证,满足标准要求,达到了预期的目的,并证明了本设计性能的稳定性和可靠性。

    标签: RFID 超高频 读卡器

    上传时间: 2013-04-24

    上传用户:lili1990

  • 基于RF通信的分体式金融POS机设计.rar

    本文介绍了一种新型金融终端(POS),其座机与手持机之间采用射频通信方式,并在射频通信中采用跳频和防碰撞设计,使得座机和手持机之间的通信速率高、稳定可靠。本设计中的金融终端还具有非接触式IC卡数据采集功能,这在设备功能上是一个巨大的创新。手持机可移动操作,方便了客户操作,在很大程度上可以帮助商家提高服务质量,非常适用于餐厅、酒店以及娱乐场所等。 本设计中的金融终端包括手持机和座机,手持机的主要功能是采集金融信息,采集的对象可以是磁条卡,接触式IC卡或非接触IC卡,采集到卡的账号和密码等信息后以射频的方式发送至座机,同时接收座机发送来的数据;座机收到手持机发送的金融信息后,再通过有线方式(电话网或以太网)发送给银行主机,交易数据处理后,银行主机将数据以有线的方式发回给座机,座机再通过无线方式发送给手持机,并打印交易凭证。文中详细介绍了手持机和座机各功能模块的硬件设计和功能实现方式,包括各主要芯片选型依据、所选芯片的特性、设计原理以及各相关模块在POS中的功能。 POS的软件设计包括硬件驱动程序(底层程序)设计和应用程序(上层应用程序)设计,底层程序跟所使用的硬件相关,是CPU控制各外围器件实现各模块硬件功能的程序,通常驱动程序会封装起来,有入口参数,供上层应用调用;上层应用程序足根据产品要实现的服务功能而编写的相关程序,上层应用程序通常需要调用底层程序。文中驱动程序主要介绍了键盘驱动,显示驱动,并重点介绍了射频通信驱动程序的设计,包括CPU如何控制射频收发芯片、为抗干扰而采取的跳频设计和设备问的防碰撞设计;应用程序中主要介绍了磁条卡和IC卡的处理程序。 由于本设计中的金融终端座机与手持机之间的通信速率较高,通信稳定可靠,同时还新增了非接触卡的数据采集功能,使该设备有较大的使用范围,从而有广阔的市场前景。

    标签: POS RF通信 分体式

    上传时间: 2013-06-27

    上传用户:1234567890qqq

  • 基于CAN总线的多节点语音通信系统设计.rar

    在实际工作现场,常常需要在一个非常恶劣的环境中进行通话,随着CAN总线在工业生产的应用越来越广泛,想到了把CAN总线应用于电话通信上来.CAN总线具有极高的总线利用率,这有可能使得我们只需要用两根CAN总线,就可以把需要通话的节点电话连接起来,从而实现语音通信. 本文主要论述了基于CAN总线的多节点语音通信系统设计.该系统使用MC14LC5480作为语音采集编解码器,AT90CAN128作为处理器,使用处理器自带的CAN模块实现多个CAN节点间的通信,最终达到实现多节点间语音通信的功能. 本文的前半部分介绍了CAN总线技术和语音信号的数字处理技术,评价了用CAN总线传输语音信号的优点.本文后半部分详细介绍了该系统的硬件结构和软件设计,通过分析系统所涉及的芯片对该系统的各个功能模块做了详细的说明,包括语音编解码电路,语音数字信号处理电路,CAN总线传输电路等.通过该系统,能够实现在实验室条件下多个CAN节点间的语音通信.

    标签: CAN 总线 节点

    上传时间: 2013-04-24

    上传用户:mingaili888

  • 基于DSP的全数字通信高频开关电源的研究与设计.rar

    随着电信业的迅猛发展,电信网络总体规模不断扩大,网络结构日益复杂先进。作为通讯支撑系统的通讯用基础电源系统,市场需求逐年增加,其动力之源的重要性也日益突出。庞大的电信网络高效、安全、有序的正常运行,对通信电源系统的品质提出了越来越严格的要求,推动了通信电源向着高效率、高频化、模块化、数字化方向发展。 本文在广泛了解通信电源的行业现状和研究热点的基础上,深入研究了开关电源的基本原理及相关技术,重点分析了开关电源功率因数技术及移相全桥软开关PWM技术的基本原理,并在这基础上设计了一款通信机房常用的48V/25A的通信电源模块,该电源模块由功率因数校正和DC/DC变换两级电路组成,采用了一些最新的技术来提高电源的性能。例如,在电路拓扑中引入软开关技术,通过采用移相全桥软开关PWM变换器实现开关管的零电压开通,减小功率器件损耗,提高电源效率;采用高性能的DSP芯片对电源实现数字PWM控制,克服了一般单芯片控制器由于运行频率有限,无法产生足够高频率和精度的PWM输出及无法完成单周期控制的缺陷;引入了智能控制技术,以模糊自适应PID控制算法取代传统的PID算法,提高了开关电源的动态性能。 整篇论文以电源设计为主线,在详细分析电路原理的基础上,进行系统的主电路参数设计、辅助电路设计、控制回路设计、仿真研究、软件实现。

    标签: DSP 全数字 通信

    上传时间: 2013-05-26

    上传用户:l254587896

  • 基于FPGA的直扩通信系统的同步设计与实现.rar

    扩频通信技术因为具有较强的抗干扰、抗噪声、抗多径衰落能力、较好的保密性、较强的多址能力和高精度测量等优点,在军事抗干扰和个人通信业务中得到了很大的发展。尤其是基于扩频理论的CDMA通信技术成为国际电联规定的第三代移动通信系统的主要标准化建议后,标志着扩频通信技术在民用通信领域的应用进入了新阶段。 近年来,随着微电子技术和电子设计自动化(EDA)技术的迅速发展,以FPGA和CPLD为代表的可编程逻辑器件凭借其设计方便灵活等特点广泛应用于数字信号处理领域。 本论文正是采用基于FPGA硬件平台来实现了一个直接序列扩频通信基带系统,该系统的实现涉及扩频通信和有关FPGA的相关知识,以及实现这些模块的VHDL硬件描述语言和QuartusⅡ开发平台,目标是实现一个集成度高、灵活性强、并具有较强的数据处理能力的扩频通信基带系统。 本论文中首先对扩频通信的基础理论做了探讨,着重对直序扩频的理论进行了分析;其次根据理论分析,设计了全数字直接序列扩频基带系统的结构,完成了扩频序列的产生、信息码的输入和扩频。重点完成了对基带扩频信号的相关解扩和几种同步捕获电路的设计,将多种专用芯片的功能集成在一片大规模FPGA芯片上。在论文中列出了部分模块的VHDL程序,并在QuartusⅡ仿真平台上完成各部分模块的功能仿真。

    标签: FPGA 直扩通信 同步设计

    上传时间: 2013-04-24

    上传用户:chenjjer

  • 基于FPGA通信原理实验系统的研究.rar

    通信与信息技术行业飞速发展,已成为我国支柱产业之一。随着该行业的迅速发展,社会对具备实际动手能力人才的需求也不断增加,高校通信教学改革势在必行。在最初的通信原理实验设备中每个实验独立占用一块硬件资源,随着EDA技术的发展,实验设备厂商将CPLD/FPGA技术作为独立的一项实验内容,加入到通信原理实验设备中。FPGA技术具备集成度高、速度快和现场可编程的优势,适合高集成度和高速的时序运算。本文总结现有通信原理实验设备的优缺点,采用FPGA技术设计出集验证性和设计性于一体,具备较高的综合性和系统性的通信原理实验系统。  本系统提供了一个开放性的硬件、软件平台,从培养学生实际动手能力出发,利用FPGA在通用的硬件上实现所有实验内容。学生在本系统上除了能完成已固化的实验内容,还可以实现电子设计开发和验证。这对培养学生的实践能力大有裨益。  本文结合数字通信系统基本模型,把基于FPGA的通信原理实验系统划分为信号源模块、发送端模块、信道仿真模块、接收端模块和同步模块几部分。其中,模拟信号源采用DDS技术,能够生成非常高的频率精度,可作为任意波形发生器。发送端和接收端模块结合到一起组成多体制调制解调器,形成多频段、多波形的软件无线电系统。载波同步采用全数字COSTAS环提取技术,具备良好的载波跟踪特性,利用对载波相位不敏感 的Gardner算法跟踪位同步信号。  本文首先介绍了通信原理实验系统的研究现状和意义;然后根据通信系统模型从《通信原理》各个章节中提炼出各模块的实验内容,分别列出各实验的数字化实现模型;继而根据各模块资源需求选取合适FPGA芯片,并给出硬件设计方案;最后,给出各模块在FPGA上具体实现过程、系统测试结果及分析。测试和实际运行结果表明设计方法正确,且功能和技术指标满足设计要求。 关键词:通信原理,实验系统,FPGA,DDS,多体制调制解调,全数字COSTAS环,位同步

    标签: FPGA 通信原理 实验系统

    上传时间: 2013-07-07

    上传用户:evil

  • TCN多功能车辆通信总线的FPGA设计.rar

    随着列车自动化控制和现场总线技术的发展,基于分布式控制系统的列车通信网络技术TCN(IEC-61375)在现代高速列车上得到广泛应用。TCN协议将列车通信网络分为绞线式列车总线WTB和多功能车辆总线MVB,其中WTB实现对开式列车中的互联车辆间的数据传输和通信,MVB实现车载设备的协同工作和互相交换信息。 本文介绍了国内外列车通信网络的发展情况和各自优势,分析了MVB一类设备底层协议。研究利用FPGA实现MVB控制芯片MVBC,用ARM作为微处理器实现MVB一类设备的嵌入式解决方案。其中,在FPGA芯片中主要采用自顶向下的设计方法,RLT硬件描述语言实现MVB控制芯片MVBC一类设备的主要功能,包括帧编码器、帧解码器和逻辑接口单元。ARM主要完成了软件程序的编写和实时操作系统的移植。在eCos实时操作系统上,完成了驱动和上层应用程序,包括端口初始化、端口配置、帧收发指令和报文分析。 为了验证设计的正确性,在设计的硬件平台基础上,搭建了MVB通信网络的最小系统,对网络进行系统功能测试。测试结果表明:设计方案正确,达到了设计的预期要求。

    标签: FPGA TCN 多功能

    上传时间: 2013-08-03

    上传用户:bruce5996

  • 用FPGA实现直接序列扩频通信.rar

    扩频通信,即扩展频谱通信技术(Spread Spectrum Communication),它与光纤通信、卫星通信一同被誉为进入信息时代的三大高技术通信传输方式。 扩频通信是将待传送的信息数据用伪随机编码序列,也即扩频序列(SpreadSequence)调制,实现频谱扩展后再进行传输。接收端则采用相同的编码进行解调及相关处理,恢复出原始信息数据。 扩频通信系统与常规的通信系统相比,具有很强的抗人为干扰,抗窄带干扰,抗多径干扰的能力,并具有信息隐蔽、多址保密通信等特点。 现场可编辑门阵列FPGA(Field Programmable Gate Array)提供了极强的灵活性,可让设计者开发出满足多种标准的产品。FPGA所固有的灵活性和性能也可让设计者紧跟新标准的变化,并能提供可行的方法来满足不断变化的标准要求。 EDA 工具的出现使用户在对FPGA设计的输入、综合、仿真时非常方便。EDA打破了软硬件之间最后的屏障,使软硬件工程师们有了真正的共同语言,使目前一切仍处于计算机辅助设计(CAD)和规划的电子设计活动产生了实在的设计实体论文对扩频通信系统和FPGA设计方法进行了相关研究,并且用Altera公司的最新的FPGA开发平台QuartusII实现了一个基带扩频通信系统的发送端部分,最后用软件Protel99SE设计了相应的硬件电路。 该系统的设计主要分为两个部分。第一部分是用QuartusII软件设计了系统的VHDL语言描述代码,并对系统中每个模块和整个系统进行相应的功能仿真和时序时延仿真;第二部分是设计了以FPGA芯片EP1C3T144C8N为核心的系统硬件电路,并进行了相关测试,完成了预定的功能。

    标签: FPGA 直接序列 扩频通信

    上传时间: 2013-07-26

    上传用户:15679277906

  • USB20加密接口芯片的设计及其FPGA验证.rar

    信息安全在当今的社会生产生活中已经被广为关注,对敏感信息进行加密是提高信息安全性的一种常见的和有效的手段。 常见的加密方法有软件加密和硬件加密。软件加密的方法因为加密速度低、安全性差以及安装不便,在一些高端或主流的加密处理中都采用硬件加密手段对数据进行处理。硬件加密设备如加密狗和加密卡已经广泛地应用于信息加密领域当中。 但是加密卡和加密狗因为采用的是多芯片结构,即采用独立的USB通信芯片和独立的加密芯片来分别实现数据的USB传输和加密功能,如果在USB芯片和加密芯片之间进行数据窃听的话,很轻易地就可以获得未加密的明文数据。作者提出了一种新的基于单芯片实现的USB加密接口芯片的构想,采用一块芯片实现数据的USB2.0通信和AES加密功能,命名为USB2.0加密接口芯片。 USB2.0加密接口芯片采用了USB2.0接口标准和AES加密算法。该加密芯片可以实现与主机的快速通信,具有快速的密码处理能力,对外提供USB接口,支持基于USB密码载体的自身安全初始化方式。 根据设计思想,课题研究并设计了USB2.0加密接口芯片的总体硬件架构,设计了USB模块和AES加密模块。为了解决USB通信模块与AES加密模块之间存在的数据处理单元匹配以及速度匹配问题,本文设计了AESUSB缓冲器,优化了AES有限域加密算法。最后,利用VerilogHDL语言在FPGA芯片上实现了USB2.0加密接口芯片的功能,并在此基础之上对加密芯片的通信和加密性能进行了测试和验证。

    标签: FPGA USB 20

    上传时间: 2013-05-24

    上传用户:黄华强