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查看全部 500 份 →基于VDHL的38译码器的实现与58分频器的实现 FPGA主芯片:CycloneII EP2C35F672C6
基于VDHL的38译码器的实现与58分频器的实现 FPGA主芯片:CycloneII EP2C35F672C6
2014-01-17
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udp,tcp/ip在智能家居芯片上的代码实现.包括芯片NE64的网络驱动源代码
udp,tcp/ip在智能家居芯片上的代码实现.包括芯片NE64的网络驱动源代码,芯片的上电初始化代码,以及完整的网络协议栈tcp/ip的实现,其中,还包括支持IPV6的可配置选项.代码的开发平台是CodeWarrior.
2015-09-26
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