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Verilog作业 ：自己写的源码输入，补码输出的，由状态机控制的四位加法器，为保证时序，加法器模块为超前近位加法器，包含测试台，通过 Modelsim 、Synplify仿真。

2014-01-21 96 自动供输

51自制编译器。本资料免费提供，但作者仍保留版权，未经本人允许，请勿随意传播。任何人可以研究本资料的源程序及电路图以学习本编程器的制作思路，但不可以任意改造并用于商业用途。否则作者将会追究其责任。各位同仁请自觉遵守。

2014-01-13 81 自动供输

/// ////HVDA高差压差动输入，定时启动，由T2定时//////////////// /////////选择4，5通道为ADC0差动转化通道////////////// /////////仪表为某速度仪，输出Vout:0-10V...

2014-01-25 145 自动供输

想要提升ADC系统的动态范围？过采样技术结合PGA可实现127dB的宽动态范围，适用于高精度信号采集场景。优化信噪比与分辨率，解决低噪声环境下的信号检测难题。

2026-03-11 1 自动供输