累加模块
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2016-10-18
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本VHDL源代码由顶层模块、测频模块、驱动模块、计算模块、LCD显示模块、复位模块组成，能精确检测从1--100M频率，误差极小且恒定。
2015-10-18
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ZLG522S系列读卡模块应用文档(加密)v1.20
基于13.56MHz频率的系列读写卡模块，它符合ISO14443标准，可支持mifare1 S50/S70、mifare0 ultralight、mifare Pro、mifare desfire，它采用超小型、超大规模集成电路封装，具有易...
2013-10-16
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