A/D转换,中断定时,当检测电流值小到一定时,认为投影仪已经关闭,延时切断电源
上传时间: 2013-07-24
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本文主要介绍了以上位机PC 为核心的RS-485 总线技术实现的集温、湿度监测和报警等功能为一体的粮仓监控系统,设计了一种零延时的RS-232/RS-485 智能型转换器,制订了上位机与下位单片机之间
上传时间: 2013-07-17
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信息化社会的到来以及IP技术的兴起,正深刻的改变着电信网络的面貌以及未来技术发展的走向。无线通信技术的发展为实现数字化社区提供了有力的保证。而视频通信则成为多媒体业务的核心。如何在环境恶劣的无线环境中,实时传输高质量的视频面临着巨大的挑战,因此这也成为人们的研究热点。 对于无线移动信道来说,网络的可用带宽是有限的。由于多径、衰落、时延扩展、噪声影响和信道干扰等原因,无线移动通信不仅具有带宽波动的特点,而且信道误码率高,经常会出现连续的、突发性的传输错误。无线信道可用带宽与传输速率的时变特性,使得传输的可靠性大为降低。 视频播放具有严格的实时性要求,这就要求网络为视频的传输提供足够的带宽.有保障的延时和误码率。为了获得可接受的重建视频质量,视频传输至少需要28Kbps左右的带宽。而且视频传输对时延非常敏感。然而无线移动网络却无法提供可靠的服务质量。 基于无线视频通信面临的挑战,本文在对新一代视频编码国际标准H.264/AVC研究的基础上,主要在提高其编码效率和H.264的无线传输抗误码性能,以及如何在嵌入式环境下实现H.264解码器进行了研究。 结合低码率和帧内刷新,提出一种针对感兴趣区的可变帧内刷新方法。实验表明该方法可以使用较少的码率对感兴趣区域进行更好的错误控制,以提高区域图像质量,同时能根据感兴趣区及信道的状况自动调整宏块刷新数量,充分利用有限的码率。 为了有效的平衡编码效率和抗误码能力的之间的矛盾,笔者提出了一种自适应FMO(Flexible Macroblock Order)编码方法,可根据图像的复杂度自适应地选择编码所需的FMO模式。仿真结果表明这种FMO编码方式完全可行,且在运动复杂度频繁变化时效果更加明显,完全可应用在环境恶劣的无线信道中。 在对嵌入式PXA270硬件结构和X264研究的基础上,基本实现了基于H.264的嵌入式解码,在PXA270基础上进行环境的配置,定制WirtCE操作系统,并编译、产生开发所用的SDK和下载内核到目标机。利用开发工具EVC实现在PC机上的实时开发和在线仿真调试,最终实现了对无差错H.264码流实时解码。
上传时间: 2013-06-18
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传统的家电采用各自独立的工作模式,不同家电之间无法通信,这样就不能有效地安排各种家电协同工作,容易造成浪费。同时它们无法自动获取外界的信息,人们无法对其进行远程操作,难以满足现代生活的需求。所以开发智能化的家电及其控制系统己成为当前的研究热点。 传统的电话只能进行语音通信,它存在利用率低、功能有限和安全性不好等缺点。近年来,以ARM为代表的高性能专用微处理器的出现,以及Linux、Windows CE等操作系统的完善,使嵌入式技术迅速发展,这为智能IP电话的研发提供了软硬件基础。 现阶段家庭网关接入互联网的方式主要为有线接入,因为这种方式网络性能比无线隐定,延时性相对要小,用它来远程控制智能家电比无线网要安全可靠。要实现智能家电的网络化,如果采用PC机进行直接进行控制,或者让每台家电接入网络,这样成本很高,不利于一般家庭的普及。 为此,笔者采用基于.ARM9芯片、Windows CE 4.2嵌入式操作系统的IP电话作为家电的控制中心,智能家电采用ARM9芯片和linux2.4操作系统。各个智能家电与IP电话采用串口进行通信,IP电话采用网口与因特网通信。这样可以大量的降低成本,而且通信方式比PLC和蓝牙通讯技术更安全可靠。 本文以IP电话与智能家电互联为切入点,结合ARM、嵌入式Linux和网络技术,设计出一种较为完善的IP电话与智能家电的控制系统。采用这种方式,使智能家电集电脑、电信和消费类电子产品的特征于一体,让家电具有信息的获取、加工、传递等功能,提供全方位的信息交换,帮助家电与外部保持信息交流畅通,这样可以优化人们的生活方式,节约能源费用资金。 笔者完成了系统硬件和软件设计,并进行了调试,验证了所设计系统的有效性和实用性。并力争将其拓展成为完善的智能家电控制系统。
上传时间: 2013-04-24
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护栏管SD卡控制器资料LED点光源控制器,IC编程,6803。8脚、14脚、18脚LED护拦管内控制IC及线路板配件,根据客户要求增减花样,调整延时。LED效果图制作
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上传时间: 2013-07-07
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众所周知,任何闭环系统在增益为单位增益l,且内部随频率变化的相移为360°时,该闭环控制系统都会存在不稳定的可能性。因此几乎所有的开关电源都有一个闭环反馈控制系统,从而能获得较好的性能。在负反馈系统中,控制放大器的连接方式有意地引入了180°相移,如果反馈的相位保持在180°以内,那么控制环路将总是稳定的。当然,在现实中这种情况是不会存在的,由于各种各样的开关延时和电抗引入了额外的相移,如果不采用适合的环路补偿,这类相移同样会导致开关电源的不稳定
上传时间: 2013-04-24
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随着Intemet网络技术、无线接入技术和无线通信技术的快速发展,传真技术有了许多新的研究方向。PC传真需利用传真软件进行传真,其功能受到传真软件的限制,而IP传真需投入的通信基础设施较大。无线传真技术具有方便快捷的特性,可快速适应市场的多样化需求,充分发挥无线通信的优势,使用户真正拥有自己的“移动办公室”,是当前无线通信研究领域的一个重点内容。 本课题在对传真通信相关基础理论以及GSM无线网络研究的基础上,设计和研制了基于G3传真的GSM网络无线传真接入终端。在本课题的设计中,建立了两段级联的传真线路,分别是主处理器与对端传真机之间的传真线路(通过T32协议实现)和主处理器与本地传真机之间的传真线路(通过T31协议实现),本课题依据T30规定的呼叫控制流程完成了这两条传真线路间的协议转换(T.32协议和T3l协议的转换),并结合GSM网络延时长、干扰大的特性进行了时延处理。同时解决了无线传真接入终端中涉及到的手机本地号段的存取算法,并在设计本课题嵌入式软件的同时抽样出基于ARM技术的系统软件设计方案(即类似于嵌入式操作系统但比操作系统简化的一个系统框架)。 通过本课题研制出的基于ARM的GSM网络G3无线传真接入终端,利用现有的G3传真机就可在GSM网络中实现无线传真业务。目前该无线传真接入终端已在北京、西安、深圳等地的商用网络上取得了成功的测试。
上传时间: 2013-04-24
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随着全球经济不断增长和信息技术持续发展,越来越多用户提出了对数据、语音和视讯等宽带接入业务的需求。传统的接入网技术己成为新一代宽带通信网络建设的瓶颈,通信网络的宽带化成为一个必然的趋势。在众多新兴的接入技术中,宽带无线接入技术以其特有的优势成为近年来通信技术市场的最大亮点。基于IEEE802.16e的WiMAX技术作为一种面向无线城域网(WMAN)的宽带接入方案,正以其优异的性能和广阔的市场前景而倍受关注。 本文是基于WiMAX技术的网络终端的设计,根据IEEE802.16e协议,物理层需要对收发信息进行编解码、调制解调等的处理,其中包含很多运算密集的算法;这些处理有些适合硬件逻辑实现,有些适合数字信号处理器实现,所以设计采用了FPGAs+DSPs的实现方式。考虑对接收和发送数据的不同处理,在详细分析上行和下行链路的工作过程的基础上,对模块的进行了详细划分,并对系统的FPGA部分进行了详细设计。 设计中本文充分考虑了FPGA和DSP之间处理的优缺点,并注意避免器件之间通信的复杂化,在满足器件之间数据流量的同时,尽量使数据流向简单化,避免了延时增加和接口带宽调度的复杂化。最终整个设计完成完整的802.16e网络终端的物理层基带处理功能。
上传时间: 2013-06-01
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本文首先在介绍多用户检测技术的原理以及系统模型的基础上,对比分析了几种多用户检测算法的性能,给出了算法选择的依据。为了同时克服多址干扰和多径干扰,给出了融合多用户检测与分集合并技术的接收机结构。 接着,针对WCDMA反向链路信道结构,介绍了扩频使用的OVSF码和扰码,分析了扰码的延时自相关特性和互相关特性,指出了存在多址干扰和多径干扰的根源。在此基础上,给出了解相关检测器的数学公式推导和结构框图,并仿真研究了用户数、扩频比、信道估计精度等参数对系统性能的影响。 常规的干扰抵消是基于chip级上的抵消,需要对用户信号重构,因此具有较高的复杂度。在解相关检测器的基础上,衍生出符号级上的干扰抵消。通过仿真,给出了算法中涉及的干扰抑制控制权值、干扰抵消级数等参数的最佳取值,并进行了算法性能比较。仿真结果验证了该算法的有效性。 最后,介绍了WCDMA系统移动台解复用技术的硬件实现,在FPGA平台上分别实现了与基站和安捷伦8960仪表的互联互通。
上传时间: 2013-07-29
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随着电信数据传输对速率和带宽的要求变得越来越迫切,原有建成的网络是基于话音传输业务的网络,已不能适应当前的需求.而建设新的宽带网络需要相当大的投资且建设工期长,无法满足特定客户对高速数据传输的近期需求.反向复用技术是把一个单一的高速数据流在发送端拆散并放在两个或者多个低速数据链路上进行传输,在接收端再还原为高速数据流.该文提出一种基于FPGA的多路E1反向复用传输芯片的设计方案,使用四个E1构成高速数据的透明传输通道,支持E1线路间最大相对延迟64ms,通过链路容量调整机制,可以动态添加或删除某条E1链路,实现灵活、高效的利用现有网络实现视频、数据等高速数据的传输,能够节省带宽资源,降低成本,满足客户的需求.系统分为发送和接收两部分.发送电路实现四路E1的成帧操作,数据拆分采用线路循环与帧间插相结合的方法,A路插满一帧(30时隙)后,转入B路E1间插数据,依此类推,循环间插所有的数据.接收电路进行HDB3解码,帧同步定位(子帧同步和复帧同步),线路延迟判断,FIFO和SDRAM实现多路数据的对齐,最后按照约定的高速数据流的帧格式输出数据.整个数字电路采用Verilog硬件描述语言设计,通过前仿真和后仿真的验证.以30万门的FPGA器件作为硬件实现,经过综合和布线,特别是写约束和增量布线手动调整电路的布局,降低关键路径延时,最终满足设计要求.
上传时间: 2013-07-16
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