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The CD4035B 4-bit parallel-in/parallel-out shift register is amonolithic complementary MOS (C

2023-11-22 3 移位加

· 摘要：  本文从移位器的功能描述、结构分析入手,并详细阐述了一款16位DSP处理器的高频率低功耗移位器的三个模块的设计. 

2024-07-08 7 移位加

加法器树乘法器结合了移位相加乘法器和查找表乘法器的优点。它使用的加法器数目等于操作数位数减 1 ，加法器精度为操作数位数的2倍，需要的与门数等于操作数的平方。因此 8 位乘法器需要7个15位加法器和64个与门

2014-01-18 22 移位加

其乘法器原理是：乘法通过逐项移位相加原理来实现，从被乘数的最低位开始，若为1，则乘数左移后与上一次的和相加；若为0，左移后以全零相加，直至被乘数的最高位

2013-12-24 74 移位加

4位全加器原码，包括仿真码和4位计数器码。

2015-09-25 148 移位加

8位相加乘法器，具有高速，占用资源较少的优点

2014-08-06 127 移位加

求两位数字的加，减，乘，除，虽然程序简单但是写的很好，可以参考一下。8086测试通过

2014-07-03 115 移位加

16位高速加法器，采用verilog语言编写，已经成功仿真，能够运行

2013-12-24 167 移位加