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查看全部 500 份 →基于FPGA 的GPS高精度短时标设计
鉴于短时标在航天、电子及电力系统中的需求,本文阐述了以FPGA 为主处理器对GPS 接收机进行数据采集处理,提供高精度短时标及短时标对应的时间码相关信息。为了确保时标的精度,减少时间信息解码过程中的采
2023-11-19
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2014-01-24
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注1: 含有不可综合语句
注1: 含有不可综合语句,请自行修改 注2: 一些PLD只允许I/O口对外三态,不支持内部三态,使用时要注意 注3: 设计RAM的最好方法是利用器件厂家提供的软件自动生成RAM元件,并在VHDL程序中例化
2016-05-03
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