相噪

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基于实际项目验证的相位噪声到时间抖动转换方法，精准解析采样时钟对ADC性能的影响。工程师必备的信号完整性分析工具包，涵盖关键计算公式与工程实践指导。

2026-01-14 2 相噪

FPGA器件在通信、消费类电子等领域应用越来越广泛，随着FPGA规模的增大、功能的加强对时钟的要求也越来越高。在FPGA中嵌入时钟发生器对解决该问题是一个不错的选择。本论文首先，描述并分析了电荷泵锁相环时钟发生器的体系结构、组成单元及各单元...

2024-01-11 8 相噪

利用锁相环(PLL)和YTO相结合,设计出一种频率合成器。实现了3～7 GHz的频率覆盖和低于0.2 Hz的频率分辨率。全频段相噪均在-108 dBc/Hz@10 kHz以下,具有较高的实用价值。

2013-10-31 158 相噪