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八皇后问题，给定皇后个数，当然这里是8，求共有多少种摆法...

📅 2014-01-20 👤 hjshhyy

设计实现4bit FIFO, 数据深度为8，产生满，空状态标志...

📅 2013-12-26 👤 123456wh

4bit FIFO 设计实现数据

1、用feng模块将选手按下按键信号输出高电平给锁存模块lockb，进行锁存的同时发出aim信号实现声音提示，并使count模块进行答题时间的倒计时，在计满100妙后送出声音提示； 2、用ch41a模块将抢答结果转换为二进制数； 3、用sel模块产生数码管片选信号； 4、用ch42a模块...

📅 2013-12-21

lockb feng 模块按键

FIFO的VHDL编程，其中包括FIFO的读，写，满帧，半满帧信号驱动...

📅 2013-12-15 👤 yyyyyyyyyy

FIFO VHDL 编程

一个深度为32，字长为8_bit FIFO（先进先出）寄存器，有寄存器空、寄存器满和寄存器溢出信号。...

📅 2014-01-06 👤 徐孺

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