正交采样

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本文提出基于FPGA的高速AD采样设计,给出了基于FPGA的高速采样时钟设 计方案以及FPGA对时钟芯片AD9516_4与ADC的配置设置,并对采样结果有效位数进行测定。 结果证明该设计灵活、简单、通用性强。

2025-03-31 7 正交采样

用递推法产生正交多项式系，即求alpha[j+1]、beta[j] 入口参数：m是数据点数，n是拟合的最高阶数， float x[],float y[]是对应纵横坐标，出口参数：a[] 是最小二乘拟合参数，alpha[]、beta[]是递推...

2014-01-19 36 正交采样