智能手机以及新一代移动通信技术的迅速崛起，使得人们的日常生活变得更加便利和丰富多彩。在此同时，旅游行业对于智能导游的服务也变得越来越重视，游客的需求也越来越强烈！在此背景下，对智能导游服务进行了深入的了解和研究，并结合先进的“云计算”技术和B/S架构模式，提出了一套基于Android平台的智能云导游系统，内容新颖，实用可靠，有一定的推广和应用价值。
上传时间： 2013-10-28
上传用户：xcsx1945
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上传时间： 2014-01-06
上传用户：gaojiao1999
为了提高企业工资支付保障信息化服务水平和整体运作效率，减轻工作人员的劳动强度，提升服务品质，全面降低企业工资支付保障运作成本，设计了一种基于RFID的企业工资支付保障平台。重点研究了云的系统模型以及其总体架构、业务流程、功能模块和物理结构。应用结果表明，该方案可有效地集成和管理实现企业工资支付保障信息管理系统的网络化，系统实施之后， 企业工资支付保障的工作效率得到了明显的提高。
上传时间： 2013-10-29
上传用户：1101055045
无线技术的持续演进发展、全球无线用户的激增，以及市场对更强大数据承载能力的需求，全面催生了各种新标准的不断涌现，如宽带码分多址 － 高速分组接入 (WCDMA-HSPA)、WCDMA-HSPA+ 以及长期演进技术 (LTE) 等。基于无线服务网络的数据使用呈指数级增长，从而进一步推动了异构网络的出现 —— 支持宏蜂窝基站和小型蜂窝基站的分层网络部署方案。
上传时间： 2013-11-25
上传用户：cc1915
MMS(MicrosoftMediaServerprotocol)是一种串流媒体传送协议，用来访问并流式接收Windows Media服务器中.asf文件的一种协议。MMS协议用于访问Windows Media发布点上的单播内容。MMS是连接Windows Media单播服务的默认方法。
上传时间： 2013-10-13
上传用户：asddsd
深入浅出C#三层架构
标签： 三层架构
上传时间： 2013-11-08
上传用户：dvfeng
Xilinx UltraScale™ 架构针对要求最严苛的应用，提供了前所未有的ASIC级的系统级集成和容量。 UltraScale架构是业界首次在All Programmable架构中应用最先进的ASIC架构优化。该架构能从20nm平面FET结构扩展至16nm鳍式FET晶体管技术甚至更高的技术，同 时还能从单芯片扩展到3D IC。借助Xilinx Vivado®设计套件的分析型协同优化，UltraScale架构可以提供海量数据的路由功能，同时还能智能地解决先进工艺节点上的头号系统性能瓶颈。 这种协同设计可以在不降低性能的前提下达到实现超过90%的利用率。 UltraScale架构的突破包括： • 几乎可以在晶片的任何位置战略性地布置类似于ASIC的系统时钟，从而将时钟歪斜降低达50% • 系统架构中有大量并行总线，无需再使用会造成时延的流水线，从而可提高系统速度和容量 • 甚至在要求资源利用率达到90%及以上的系统中，也能消除潜在的时序收敛问题和互连瓶颈 • 可凭借3D IC集成能力构建更大型器件，并在工艺技术方面领先当前行业标准整整一代 • 能在更低的系统功耗预算范围内显著提高系统性能，包括多Gb串行收发器、I/O以及存储器带宽 • 显著增强DSP与包处理性能 赛灵思UltraScale架构为超大容量解决方案设计人员开启了一个全新的领域。
标签： UltraScale Xilinx 架构
上传时间： 2013-12-23
上传用户：小儒尼尼奥
通用FPGA架构汇总
上传时间： 2014-01-16
上传用户：金宜
随着消费者数据需求量的不断攀升，全球范围内的运营商无一不面临着对无线带宽前所未有的增长需求。值得庆幸的是，包括标准制定机构 3GPP 等在内的整个行业都在竭尽全力来支持这种需求。LTE 正是为帮助运营商满足这一指数级数据增长需求应运而生的最佳技术选择。由于 LTE 部署实施已趋成熟，基站制造商纷纷热衷于采用片上系统架构(SoC)，以使运营商可在维持并提升服务质量的同时还能大幅降低网络成本。
上传时间： 2015-01-02
上传用户：墙角有棵树
pcie基本概念及其工作原理介绍：PCI Express®（或称PCIe®），是一项高性能、高带宽，此标准由互连外围设备专业组（PCI-SIG）制 订，用于替代PCI、PCI Extended (PCI-X)等基于总线的通讯体系架构以及图形加速端口（AGP）。 转向PCIe主要是为了实现显著增强系统吞吐量、扩容性和灵活性的目标，同时还要降低制造成本，而这 些都是基于总线的传统互连标准所达不到的。PCI Express标准在设计时着眼于未来，并且能够继续演 进，从而为系统提供更大的吞吐量。第一代PCIe规定的吞吐量是每秒2.5千兆比特（Gbps），第二代规 定的吞吐量是5.0 Gbps，而最近公布PCIe 3.0标准已经支持8.0 Gbps的吞吐量。在PCIe标准继续充分利 用最新技术来提供不断加大的吞吐量的同时，采用分层协议也便于PCI向PCIe的演进，并保持了与现有 PCI应用的驱动程序软件兼容性。 虽然最初的目标是计算机扩展卡以及图形卡，但PCIe目前也广泛适用于涵盖更广的应用门类，包括网络 组建、通信、存储、工业电子设备和消费类电子产品。 本白皮书的目的在于帮助读者进一步了解PCI Express以及成功PCIe成功应用。 PCI Express基本工作原理 拓扑结构 本节介绍了PCIe协议的基本工作原理以及当今系统中实现和支持PCIe协议所需要的各个组成部分。本节 的目标在于提供PCIe的相关工作知识，并未涉及到PCIe协议的具体复杂性。 PCIe的优势就在于降低了复杂度所带来的成本。PCIe属于一种基于数据包的串行连接协议，它的复杂度 估计在PCI并行总线的10倍以上。之所以有这样的复杂度，部分是由于对以千兆级的速度进行并行至串 行的数据转换的需要，部分是由于向基于数据包实现方案的转移。 PCIe保留了PCI的基本载入-存储体系架构，包括支持以前由PCI-X标准加入的分割事务处理特性。此 外，PCIe引入了一系列低阶消息传递基元来管理链路（例如链路级流量控制），以仿真传统并行总线的 边带信号，并用于提供更高水平的健壮性和功能性。此规格定义了许多既支持当今需要又支持未来扩展 的特性，同时还保持了与PCI软件驱动程序的兼容性。PCI Express的先进特性包括：自主功率管理； 先进错误报告；通过端对端循环冗余校验（ECRC）实现的端对端可靠性，支持热插拔；以及服务质量（QoS）流量分级。
上传时间： 2013-11-29
上传用户：zw380105939
