📚 最高频率技术资料

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DDR控制器的VHDL源代码.采用FPGA实现DDR接口控制器,适用于Altera的FPGA,最高频率可到100M

DDR控制器的VHDL源代码.采用FPGA实现DDR接口控制器,适用于Altera的FPGA,最高频率可到100M...

📅 2014-12-02 👤 bcjtao

FPGA DDR Altera 100M

有限状态机的并行编码,采用并行编码可以有效提高系统最高频率,次态时间充分被利用.

有限状态机的并行编码,采用并行编码可以有效提高系统最高频率,次态时间充分被利用....

📅 2014-12-06 👤 rishian

并行编码有限状态机分最高频率

针对主控制板上存储器(SRAM) 存储的数据量小和最高频率低的情况,提出了基于SDR Sdram(同步动态RAM) 作为主存储器的LED 显示系统的研究。在实验中,使用了现场可编程门阵列( FPGA)

针对主控制板上存储器(SRAM) 存储的数据量小和最高频率低的情况,提出了基于SDR Sdram(同步动态RAM) 作为主存储器的LED 显示系统的研究。在实验中,使用了现场可编程门阵列( FPGA) 来实现各模块的逻辑功能。最终实现了对L ED 显示屏的控制,并且一块主控制板最大限度的控制了256...

📅 2013-12-18 👤 c12228

Sdram SRAM FPGA SDR