时序收敛
时序收敛（英语：Timingclosure）是现场可编程逻辑门阵列、专用集成电路等集成电路设计过程中，调整、修改设计，从而使得所设计的电路满足时序要求的过程。
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· 摘要： 基于GP2015射频芯片和TMS320C6713 DSP处理器,提出了一种GPS软件接收机信号实时接收及传输的基本方案.介绍了射频前端的基本构造以及它与DSP进行高速实时传输的接口方案,并且重点描述了一种基...
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