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数字闹钟的设计
采用AT可编程器件,用ADC0809采集电压信号。
数字功放设计 英
简易数字频率计,用Verilog HDL编写的,基于Quartus II实现,结构清晰,功能较为全面,能满足简单的频率测量要求
数字锁相环设计,深入了解锁相环设计,对于想要了解锁相环内部机理的朋友是很有帮助的
数字秒表的设计,reset为归零设置,start为重新计时设置
数字电子钟设计,整点报时,时分秒分模块设计,另附实验报告和实验结果,内容详细不容错过
数字频率计程序,网上下载后已改动过,能用
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