数字秒表

数字秒表主要由：分频器、扫描显示译码器、一百进制计数器、六十进制计数器（或十进制计数器与6进制计数器）、十二进制计数器（或二十四进制计数器）电路组成。在整个秒表中最关键的是如何获得一个精确的100HZ计时脉冲，除此之外，数字秒表需有清零控制端，以及启动控制端、保持保持，以便数字时钟能随意停止及启动。...

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数字秒表 热门资料

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60秒秒表设计，可暂停和分段计数等，所有功能是利用verilog HDL来描述，最后下载到CPLD/FPGA才能运行。

2017-06-08 109 数字秒表

利用一块芯片完成除时钟源、按键、扬声器和显示器（数码管）之外的所有数字电路功能。所有数字逻辑功能都在CPLD器件上用VHDL语言实现。这样设计具有体积小、设计周期短（设计过程中即可实现时序仿真）、调试方便、故障率低、修改升级容易等特点。 ...

2013-10-24 96 数字秒表

双数码管可调秒表，。由于单片机I/O资源足够，所以双数码管可接成静态显示方式，两个共阴数码管分别接在P1（秒十位）和P2（秒个位）口，它们的共阴极都接地，安排两个按键接在P3.2（十位数调整）和P3.3（个位数调整）上，为了方便计时，选用1...

2017-04-12 105 数字秒表

基于51单片机实现的秒表系统，支持按键控制开始、暂停与继续，代码结构清晰，适合嵌入式开发实战。可直接用于项目开发，经过多个实际应用验证，具备良好的稳定性与可扩展性。

2026-03-08 1 数字秒表