数字测相
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查看全部 500 份 →基于FPGA的数字三相锁相环的优化设计
数字三相锁相环中含有大量乘法运算和三角函数运算，占用大量的硬件逻辑资源。为此，提出一种数字三相锁相环的优化实现方案，利用乘法模块复用和CORDIC算法实现三角函数运算，并用Verilog HDL硬件描述语言对优化前后的算法进行了编码实现。仿...
2013-11-15
148
基于FPGA的数字三相锁相环的优化设计
数字三相锁相环中含有大量乘法运算和三角函数运算，占用大量的硬件逻辑资源。为此，提出一种数字三相锁相环的优化实现方案，利用乘法模块复用和CORDIC算法实现三角函数运算，并用Verilog HDL硬件描述语言对优化前后的算法进行了编码实现。仿...
2013-10-22
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低频数字相位测量仪使用单片机和FPGA来共同实现
低频数字相位测量仪使用单片机和FPGA来共同实现，FPGA完成测量时间差，而单片机完成数据的读取、键盘控制和显示等功能。
2016-03-09
149
XAPP854-数字锁相环(DPLL)参考设计
Many applications require a clock signal to be synchronous, phase-locked, or derived fromanother signal, such as a data ...
2014-12-23
67