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FPGA 可编程ASIC集成数字系统
可编程ASIC集成数字系统
技术书籍 可编程ASIC集成数字系统-420页-11.1M.rar
专辑类----可编程逻辑器件相关专辑 可编程ASIC集成数字系统-420页-11.1M.rar
技术书籍 可编程ASIC集成数字系统-420页-11.1M.pdf
专辑类-可编程逻辑器件相关专辑-96册-1.77G 可编程ASIC集成数字系统-420页-11.1M.pdf
教程资料 设计了一种基于ＣＰＬＤ（复杂可编程逻辑器件）的低频数字相位测量仪
设计了一种基于ＣＰＬＤ（复杂可编程逻辑器件）的低频数字相位测量仪
教程资料 基于FPGA的可编程数字滤波器系统
基于FPGA的可编程数字滤波器系统,基于FPGA的数字滤波器的设计与实现,基于FPGA流水线分布式算法的FIR滤波器的实现
VHDL/FPGA/Verilog 按键输入模块（key）： --可编程延时发生器（数字同步机）的前端输入模块：0－9十个数字键按键输入模块原型 --前端模块：消抖 --对i0－i9十个输入端的两点要求： --（1）输入端要保证
按键输入模块（key）：
--可编程延时发生器（数字同步机）的前端输入模块：0－9十个数字键按键输入模块原型
--前端模块：消抖
--对i0－i9十个输入端的两点要求：
--（1）输入端要保证一段时间的稳定高电平
--（2）不能同时按下两个或多于两个的键
--后级模块：1、编码；2、可变模计数器
--编码模块：8线－4线（0－8 BCD码） ...
VHDL/FPGA/Verilog 用复杂可编程逻辑器件(CPLD)实现的数字钟控系统
用复杂可编程逻辑器件(CPLD)实现的数字钟控系统
通讯编程文档 直接数字合成(DDS)技术具有信号频率分辨率高、控制灵活、可编程及任意波形输出等优 点
直接数字合成(DDS)技术具有信号频率分辨率高、控制灵活、可编程及任意波形输出等优
点
通讯编程文档 基于可编程逻辑器件CPLD和直接数字频率合成技术（DDS）的三相多波形函数发生器
基于可编程逻辑器件CPLD和直接数字频率合成技术（DDS）的三相多波形函数发生器
系统设计方案 摘要：介绍了基于可编程逻辑器件CPLD和直接数字频率合成技术（DDS）的三相多波形函数发生器的基本原理
摘要：介绍了基于可编程逻辑器件CPLD和直接数字频率合成技术（DDS）的三相多波形函数发生器的基本原理，并在此基础上给出了基于CPLD的各模块设计方法及其VHDL源程序