心跳同步

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发送端在时钟控制下，伪码发生器产生伪随机序列去控制频率合成至生成跳频载波系列，称做跳频图案。跳频通信系统的原理框图见上图。图中接收端的预调制滤波器是一种中心频率随信号跳频式样而同步跳变的窄带滤波器（通频带允许所需信号通过），目的在于增加接收...

2023-01-10 10 心跳同步

本例演示：1、画两个同心圆，其中一个半径由独立输入宗量定义，另一个由变长度输入宗量的第一个元素定义，可以用任何指定的色彩线形绘制；2、变长度输入输出宗量在程序中的构成和使用；3、变长度输入输出宗量的对外使用表现

2014-06-06 196 心跳同步

使用Verilog编写的同步FIFO，可通过设置程序中的DEPTH设置FIFO的深度，FIFO_WRITE_CLOCK上升沿向FIFO中写入数据，\r\nFIFO_READ_CLOCK上升沿读取数据。本程序对FIFO上层操作简单实用。

2013-08-12 131 心跳同步