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异步置位复位D触发器，基于VHDL硬件描述语言的仿真。
异步串口通信VHDL源代码，通过了验证，最高通信速率可达384
verilog编写的异步fifo源代码，asyn_fifo.v为顶层，调用其他四个文件
测试神经网络异或问题，只是一个很小的程序，希望大家能多多指教。
异步FIFO设计的说明文档，需要注意的问题以及源码（在文中有）。是标准的异步FIFO，可综合。
usb-cy7c68013异步写传输代码verilog
球体的磁异常正演程序，模拟了地质体在地下的磁异常情况。
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