延迟测试
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查看全部 500 份 →FPGA的多路可控脉冲延迟系统.docx
1 系统功能 本系统拟定对频率范围在1~50 kHz左右的TTL电平脉冲序列进行多路延迟处理。各路延迟时间分别由单片机动态设定，最大延迟时间为1 ms，最大分辨率为0.15 ns级。 3 方...
2015-04-25
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两通道低延迟滤波器组的设计
本文提出了一种用有效的迭代拉格朗日乘子法设计精确重构的两通道低延迟滤波器组.该方法具有较高的计算效率，既能设计不同长度也能设计相同长度的滤波器组.文中给出了设计例子并与其它方法进行了比较.结果表明，用该方法设计的两通道低延迟滤波器组具有更高...
2023-09-14
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