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多路复用技术

  • 基于时延差和频分复用的节点定位系统

    在机器人的广泛应用中,为了获取各种参数和数据,确定各机器人基站的相对位置是极为重要的。为了安全和节省成本,对传感器网络采用了时延差定位算法和频分复用传输模式,即可获得传感器网络节点的相对位置。定位系统的搭建包括发射和接收两部分,并采用了水声换能器进行电-声转换和声-电转换。通过测试,该定位系统利用测试发射和接收信号之间的时间间隔,得到水下机器人传感器网络的相对位置,且满足一定的定位精度。

    标签: 时延 频分复用 节点定位

    上传时间: 2013-10-20

    上传用户:hebanlian

  • 基于Si1000多路无线遥控开关的设计

    针对现有遥控电器开关的节电性不好、使用寿命短等缺点,文中采用低功耗芯片Si1000,设计了一种新的可编程无线遥控多路开关,以实现对多路照明灯的遥控控制。详细阐述了整个电路的软硬件设计,并对其进行了实验验证,为无线电遥控提供了合理、可靠的解决方案。

    标签: 1000 Si 多路 无线遥控开关

    上传时间: 2014-04-24

    上传用户:zhyfjj

  • 基于电话网络的多路无线防盗报警系统

    为了满足远程防盗报警的需要,提出了一种基于电话网络的多路无线防盗报警系统,并完成系统的软硬件设计。该系统由多路探测器和主机构成,探测器采用热释电红外传感器探测入侵者,并以无线方式发送报警位置编码给主机。主机接收解码探测器信号,并通过电话网络自动拨打报警电话。主机提供人机接口,可设置报警电话号码和录制报警语音,并提供撤防和布防控制。实际应用表明,系统工作稳定,达到设计要求。

    标签: 电话网络 多路 无线防盗 报警系统

    上传时间: 2013-12-21

    上传用户:mikesering

  • 多路多节功分器的设计与传输线问题的研究

    文章的设计是采用内部互联一分二功分器的方法来实现多路功分器, 因为实际制作中很难将一分二功分器直接相连, 所以在一分二功分器之间需要采用传输线进行连接, 本文主要研究了内部互联多路多节功分器的性能以及传输线对内部互联多路多节功分器的影响。

    标签: 多路 功分器 传输线

    上传时间: 2013-10-26

    上传用户:15501536189

  • MIMO系统中分集增益和空间复用增益的折衷关系

    论文导出了分集增益与空间复用增益间的最佳折衷关系式。该关系式为阶梯递减右连续函数,阶梯数等于接收天线数目。分集增益的取值与分组长度有关,只有当分组长度不小于发射天线数目时才能获得满分集增益。折衷关系表明,采用合适的空时编码可以同时获得分集增益和空间复用增益,但是两种增益不能同时达到最大。由最佳折衷关系可以推测一定空间复用增益时可得到的最大分集增益,以及一定分集增益时能获得的最大空间复用增益  

    标签: MIMO 分集增益 空间复用增益

    上传时间: 2013-11-07

    上传用户:mnacyf

  • 无中心多路对讲通信系统设计要求

      一、任务   设计一个无中心站点的多路对讲通信系统,系统原理框图如下   对讲通信系统,能对20米以外的各单元进行呼叫与对讲,通过无线传输进行语音的传输。   二、要求

    标签: 多路 对讲 通信 系统设计

    上传时间: 2013-11-10

    上传用户:zhuyibin

  • 基于STC12C5A的多路检测智能防盗报警器研究

    以STC12C5A单片机为核心,结合多路激光探测电路、红外探测电路、实时控制电路、数字语音录放电路、振动探测电路、远程拨号电路和大功率强光报警和声音报警,以及其他的外围辅助电路,构成了一款高性能的智能安防报警器。可实现防盗、防火等安防功能。它能智能地区分各种警情、自动数字语音电话报警,可接收远端的电话遥控指令,有大功率继电输出口。

    标签: STC 12C 12 C5

    上传时间: 2013-10-11

    上传用户:zgu489

  • 基于FPGA的无人机多路视频监控系统设计

    为了能实时监控无人机的状态和提高无人机的安全可靠性,本设计利用FPGA高速率、丰富的片上资源和灵活的设计接口,设计了一套无人机多路监控系统。该监控系统具备了将处于无人机不同位置的摄像机所采集的视频信息,传送给地面站控制设备,并在同一台显示器上实现同步显示的功能。仿真结果表明,该系统可以很好的保证监控视频的实时性、和高清度,确保无人机完成侦查任务。

    标签: FPGA 无人机 多路 视频监控

    上传时间: 2013-10-24

    上传用户:baiom

  • 基于FPGA的多路高速串并转换器设计

    高速串并转换器的设计是FPGA 设计的一个重要方面,传统设计方法由于采用FPGA 的内部逻辑资源来实现,从而限制了串并转换的速度。该研究以网络交换调度系统的FGPA 验证平台中多路高速串并转换器的设计为例,详细阐述了1 :8DDR 模式下高速串并转换器的设计方法和16 路1 :8 串并转换器的实现。结果表明,采用Xilinx Virtex24 的ISERDES 设计的多路串并转换器可以实现800 Mbit/ s 输入信号的串并转换,并且减少了设计复杂度,缩短了开发周期,能满足设计要求。关键词:串并转换;现场可编程逻辑阵列;Xilinx ; ISERDES

    标签: FPGA 多路 串并转换

    上传时间: 2013-11-17

    上传用户:hxy200501

  • JSVM核心类库,收集了JAVA进行JSVM开发必用技术进行归纳,在实际项目应用中直接引用相关类库即可现实JSVM相关功能!

    JSVM核心类库,收集了JAVA进行JSVM开发必用技术进行归纳,在实际项目应用中直接引用相关类库即可现实JSVM相关功能!

    标签: JSVM JAVA 核心

    上传时间: 2014-01-03

    上传用户:hewenzhi