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Section 2– Configuration, Clocking, Low Power Modes, andInternal Memory Map1. SCCE2 Register
· 摘要： 雷达和声纳自导信号处理需要多个DSP和多个上位机联合工作.本文给出了基于VME总线的上位机与多个DSPHPI之间通过DMA方式进行并行通信的接口设计方案.实验和工程实践证明,采用DMA方式的设计方案比采用直...
·摘要： 提出一种嵌入式异构多处理器系统的结构模型,论述这种系统的通信机制,并阐述在基于这种嵌入式异构多处理器系统模型的实时图像处理系统中,运算节点采用由TI公司的TMS320C6416 DSP芯片构造的信号处理板时,在运算节点...
在对大量程序访存行为进行分析的基础上，提出基于步长和指针的预取方法。能捕获规整的数据访问模式和指针访问模式。在L2 cache 和内存之间采用全局历史缓存实现该预取方法。全系统模拟结果表明，该预取方法
·摘要： 提出了一种通用、高效的基于FPGA的多DSP并行处理系统,并对其进行了仿真.从仿真结果来看,该系统的数据读写时序与DSP芯片要求的数据读写时序完全吻合,可实现数据的高速并行处理,并达到了设计的目的. &nbs...
· 摘要： 针对实时图像高帧频、高分辨率、多通道趋势和图像处理并行算法的多样性对多处理器系统结构的要求,研究了传统固定结构并行系统与并行算法的关系及其不足,构建了基于多DSP+FPGA结构的高性能可重构数字图像并行处理...