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提出了欧氏算法和IDFT相结合的RS码流式解码方案,并在FPGA芯片上予以实现。计算机仿真和实测表明,该方案在GF(28)的符号速率可达50MHz以上,最大延时为640ns,满足了高速宽带无线接入网中抗干扰编译码的需求。...

📅 👤 yulg
IDFT FPGA 640 MHz

💻 可重构计算机源代码

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基于arm＋fpga的可重构控制器设计及其在加载系统中的应用.pdf
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基于arm的嵌入式可重构数控系统的设计与实现.pdf
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基于fpga部分动态可重构的信号解调系统的实现.pdf
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