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VHDL/FPGA/Verilog 用复杂可编程逻辑器件(CPLD)实现的数字钟控系统

用复杂可编程逻辑器件(CPLD)实现的数字钟控系统

https://www.eeworm.com/dl/663/159468.html

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DSP编程  以两片由TI 公司生产的数字信号处理器TMS320C6203B 为核心,用可编程逻辑阵列CPLD 进行逻辑控制,采用现场可编程门阵列FPGA 作图像的预处理和进行双数字信号处理器(DSP) 之间的

以两片由TI 公司生产的数字信号处理器TMS320C6203B 为核心,用可编程逻辑阵列CPLD 进行逻辑控制,采用现场可编程门阵列FPGA 作图像的预处理和进行双数字信号处理器(DSP) 之间的通讯,实现了实时相关的图像处理。此系统实时性好,可直接利用数字图像的灰度特征,在低信噪比的情况下目标跟踪点漂移小,目标跟踪能够较好地适应不 ...

https://www.eeworm.com/dl/516/294705.html

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VHDL/FPGA/Verilog 本文介绍了乐曲演奏电路的设计与实现中涉及的CPLD／FPGA可编程逻辑控件,开发环境MAX+PLUSⅡ,硬件描述语言HDL以及介绍了在MAX+PLUSⅡ的EDA 软件平台上, 一种基于FPGA 的乐曲

本文介绍了乐曲演奏电路的设计与实现中涉及的CPLD／FPGA可编程逻辑控件,开发环境MAX+PLUSⅡ,硬件描述语言HDL以及介绍了在MAX+PLUSⅡ的EDA 软件平台上, 一种基于FPGA 的乐曲发生器的设计方法, 并给出了设计的顶层电路图和底层模块的VHDL（或AHDL）源程序。该设计的正确性已通过硬件实验得到验证。 ...

https://www.eeworm.com/dl/663/471162.html

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电子书籍  无沦是用离散逻辑、可编程逻辑

无沦是用离散逻辑、可编程逻辑，还是用全定制硅器件实现的任何数字设计，为了成功地操作，可靠的时钟是非常关键的。设计不良的时钟在极限的温度、电压或制造工艺的偏差情况下将导致错误的行为，并且调试困难、花销很大。在设计PLD/FPGA时通常采用几种时钟类型。时钟可分为如下四种类型：全局时钟、门控时钟、多级逻辑时 ...

https://www.eeworm.com/dl/cadence/ebook/145936.html

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单片机开发  这是我在ISP编程课上独立编写的一个采用模块化+行为描述方式实现的可控脉冲发生器。程序有四个并行模块：减数器&控制模块（用于设置发生脉冲数量并记数

这是我在ISP编程课上独立编写的一个采用模块化+行为描述方式实现的可控脉冲发生器。程序有四个并行模块：减数器&控制模块（用于设置发生脉冲数量并记数，同时产生控制信号）、脉冲发生模块（用于接受控制信号并产生脉冲输出）、脉冲接收模块（用于接收脉冲输出并记录脉冲个数）、显示模块（将接受模块记录到的脉冲总数显示 ...

https://www.eeworm.com/dl/648/394021.html

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MAX+plusⅡ ALTERA可编程逻辑器件及其应用

ALTERA可编程逻辑器件及其应用

https://www.eeworm.com/dianzishu/407/410.html

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FPGA MACH可编程逻辑器件及其开发工具

MACH可编程逻辑器件及其开发工具

https://www.eeworm.com/dianzishu/437/2434.html

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FPGA 可编程逻辑器件PLD原理与应用 NLC版

可编程逻辑器件PLD原理与应用 NLC版

https://www.eeworm.com/dianzishu/437/2448.html

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FPGA ALTERA可编程逻辑器件及其应用

ALTERA可编程逻辑器件及其应用

https://www.eeworm.com/dianzishu/437/2451.html

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FPGA 可编程逻辑器件原理、开发与应用

可编程逻辑器件原理、开发与应用

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