金属氧化物压敏电阻器（MOV）,简称为压敏电阻器,它以其优越的非线性伏安特性，广泛用作线路、设备及元器件的过电压保护和浪涌吸收元件。MOV 虽有卓越的功能和作用，但是它在各种应力的作用下,总是会失效的
上传时间： 2013-05-18
上传用户：xinyuzhiqiwuwu
一、应用可靠性概念 1、可靠性概念 2、固有可靠性与应用可靠性 3、易产生应用可靠性问题的器件 4、使用应力对可靠性的影响 二、电子元器件的选用 1、电子元器件的质量等级 2、电子元器件的选择要点 3、电子元器件的最大额定值 4、电子元器件的降额应用 三、电子元器件的可靠性应用 1、电子元器件的防浪涌应用 2、电子元器件的防静电应用 3、电子元器件的防干扰应用 4、CMOS群件的防闩锁应用 四、电子元器件的EMC应用 1、干扰来源及传播路径 2、接地与屏蔽 3、滤波 4、电缆及终端 5、差分 6、软件抗干扰 五、可靠性防护元件 1、TVS二极管 2、压敏电阻 3、PTC与NTC热敏电阻 4、专用防护元件 六、电子线路的可靠性设计 1、简化设计 2、容差与漂移设计 3、冗余设计 4、低功耗设计 5、潜在通路分析 6、电磁兼容设计 7、均衡设计 七、印制电路版的可靠性设计 1、PCB的布局设计 2、PCB的布线设计 3、PCB的热设计 4、PCB的装配 八、噪声测试作为应用可靠性保证手段 1、噪声与可靠性的关系 2、噪声用于寿命评估 3、噪声用于可靠性筛选 4、噪声用于应力损伤的早期预测
上传时间： 2013-07-28
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一、应用可靠性概念 1、可靠性概念 2、固有可靠性与应用可靠性 3、易产生应用可靠性问题的器件 4、使用应力对可靠性的影响 二、电子元器件的选用 1、电子元器件的质量等级 2、电子元器件的选择要点 3、电子元器件的最大额定值 4、电子元器件的降额应用 三、电子元器件的可靠性应用 1、电子元器件的防浪涌应用 2、电子元器件的防静电应用 3、电子元器件的防干扰应用 4、CMOS群件的防闩锁应用 四、电子元器件的EMC应用 1、干扰来源及传播路径 2、接地与屏蔽 3、滤波 4、电缆及终端 5、差分 6、软件抗干扰 五、可靠性防护元件 1、TVS二极管 2、压敏电阻 3、PTC与NTC热敏电阻 4、专用防护元件 六、电子线路的可靠性设计 1、简化设计 2、容差与漂移设计 3、冗余设计 4、低功耗设计 5、潜在通路分析 6、电磁兼容设计 7、均衡设计 七、印制电路版的可靠性设计 1、PCB的布局设计 2、PCB的布线设计 3、PCB的热设计 4、PCB的装配 八、噪声测试作为应用可靠性保证手段 1、噪声与可靠性的关系 2、噪声用于寿命评估 3、噪声用于可靠性筛选 4、噪声用于应力损伤的早期预测
标签： 应用可靠性
上传时间： 2013-04-24
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·稳压电源实用手册（书），共1100页 稳压电源是各种电子线路的动力源，也是电路的核心部分。这里我们分析了引起电源出现不稳定的主要原因、技术指标和电源的分类。并对出现的问题分十一章逐一解答。第一章 绪论；第二章 稳定电源常用的一些元器件机电路；第三章 参数型稳压电源；第四章 串联反馈调整型稳压电源；第五章开关滞留稳压电源；第六章 集成稳压电源；第七章 可控硅直流稳
上传时间： 2013-05-25
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标签： WordParser ROST 分 软件
上传时间： 2013-05-20
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摘要: 介绍了时钟分相技术并讨论了时钟分相技术在高速数字电路设计中的作用。 关键词: 时钟分相技术; 应用 中图分类号: TN 79 文献标识码:A 文章编号: 025820934 (2000) 0620437203 时钟是高速数字电路设计的关键技术之一, 系统时钟的性能好坏, 直接影响了整个电路的 性能。尤其现代电子系统对性能的越来越高的要求, 迫使我们集中更多的注意力在更高频率、 更高精度的时钟设计上面。但随着系统时钟频率的升高。我们的系统设计将面临一系列的问 题。 1) 时钟的快速电平切换将给电路带来的串扰(Crosstalk) 和其他的噪声。 2) 高速的时钟对电路板的设计提出了更高的要求: 我们应引入传输线(T ransm ission L ine) 模型, 并在信号的匹配上有更多的考虑。 3) 在系统时钟高于100MHz 的情况下, 应使用高速芯片来达到所需的速度, 如ECL 芯 片, 但这种芯片一般功耗很大, 再加上匹配电阻增加的功耗, 使整个系统所需要的电流增大, 发 热量增多, 对系统的稳定性和集成度有不利的影响。 4) 高频时钟相应的电磁辐射(EM I) 比较严重。 所以在高速数字系统设计中对高频时钟信号的处理应格外慎重, 尽量减少电路中高频信 号的成分, 这里介绍一种很好的解决方法, 即利用时钟分相技术, 以低频的时钟实现高频的处 理。 1 时钟分相技术 我们知道, 时钟信号的一个周期按相位来分, 可以分为360°。所谓时钟分相技术, 就是把 时钟周期的多个相位都加以利用, 以达到更高的时间分辨。在通常的设计中, 我们只用到时钟 的上升沿(0 相位) , 如果把时钟的下降沿(180°相位) 也加以利用, 系统的时间分辨能力就可以 提高一倍(如图1a 所示)。同理, 将时钟分为4 个相位(0°、90°、180°和270°) , 系统的时间分辨就 可以提高为原来的4 倍(如图1b 所示)。 以前也有人尝试过用专门的延迟线或逻辑门延时来达到时钟分相的目的。用这种方法产生的相位差不够准确, 而且引起的时间偏移(Skew ) 和抖动 (J itters) 比较大, 无法实现高精度的时间分辨。 近年来半导体技术的发展, 使高质量的分相功能在一 片芯片内实现成为可能, 如AMCC 公司的S4405, CY2 PRESS 公司的CY9901 和CY9911, 都是性能优异的时钟 芯片。这些芯片的出现, 大大促进了时钟分相技术在实际电 路中的应用。我们在这方面作了一些尝试性的工作: 要获得 良好的时间性能, 必须确保分相时钟的Skew 和J itters 都 比较小。因此在我们的设计中, 通常用一个低频、高精度的 晶体作为时钟源, 将这个低频时钟通过一个锁相环(PLL ) , 获得一个较高频率的、比较纯净的时钟, 对这个时钟进行分相, 就可获得高稳定、低抖动的分 相时钟。 这部分电路在实际运用中获得了很好的效果。下面以应用的实例加以说明。2 应用实例 2. 1 应用在接入网中 在通讯系统中, 由于要减少传输 上的硬件开销, 一般以串行模式传输 图3 时钟分为4 个相位 数据, 与其同步的时钟信号并不传输。 但本地接收到数据时, 为了准确地获取 数据, 必须得到数据时钟, 即要获取与数 据同步的时钟信号。在接入网中, 数据传 输的结构如图2 所示。 数据以68MBös 的速率传输, 即每 个bit 占有14. 7ns 的宽度, 在每个数据 帧的开头有一个用于同步检测的头部信息。我们要找到与它同步性好的时钟信号, 一般时间 分辨应该达到1ö4 的时钟周期。即14. 7ö 4≈ 3. 7ns, 这就是说, 系统时钟频率应在300MHz 以 上, 在这种频率下, 我们必须使用ECL inp s 芯片(ECL inp s 是ECL 芯片系列中速度最快的, 其 典型门延迟为340p s) , 如前所述, 这样对整个系统设计带来很多的困扰。 我们在这里使用锁相环和时钟分相技术, 将一个16MHz 晶振作为时钟源, 经过锁相环 89429 升频得到68MHz 的时钟, 再经过分相芯片AMCCS4405 分成4 个相位, 如图3 所示。 我们只要从4 个相位的68MHz 时钟中选择出与数据同步性最好的一个。选择的依据是: 在每个数据帧的头部(HEAD) 都有一个8bit 的KWD (KeyWord) (如图1 所示) , 我们分别用 这4 个相位的时钟去锁存数据, 如果经某个时钟锁存后的数据在这个指定位置最先检测出这 个KWD, 就认为下一相位的时钟与数据的同步性最好(相关)。 根据这个判别原理, 我们设计了图4 所示的时钟分相选择电路。 在板上通过锁相环89429 和分相芯片S4405 获得我们所要的68MHz 4 相时钟: 用这4 个 时钟分别将输入数据进行移位, 将移位的数据与KWD 作比较, 若至少有7bit 符合, 则认为检 出了KWD。将4 路相关器的结果经过优先判选控制逻辑, 即可输出同步性最好的时钟。这里, 我们运用AMCC 公司生产的 S4405 芯片, 对68MHz 的时钟进行了4 分 相, 成功地实现了同步时钟的获取, 这部分 电路目前已实际地应用在某通讯系统的接 入网中。 2. 2 高速数据采集系统中的应用 高速、高精度的模拟- 数字变换 (ADC) 一直是高速数据采集系统的关键部 分。高速的ADC 价格昂贵, 而且系统设计 难度很高。以前就有人考虑使用多个低速 图5 分相技术应用于采集系统 ADC 和时钟分相, 用以替代高速的ADC, 但由 于时钟分相电路产生的相位不准确, 时钟的 J itters 和Skew 比较大(如前述) , 容易产生较 大的孔径晃动(Aperture J itters) , 无法达到很 好的时间分辨。 现在使用时钟分相芯片, 我们可以把分相 技术应用在高速数据采集系统中: 以4 分相后 图6 分相技术提高系统的数据采集率 的80MHz 采样时钟分别作为ADC 的 转换时钟, 对模拟信号进行采样, 如图5 所示。 在每一采集通道中, 输入信号经过 缓冲、调理, 送入ADC 进行模数转换, 采集到的数据写入存储器(M EM )。各个 采集通道采集的是同一信号, 不过采样 点依次相差90°相位。通过存储器中的数 据重组, 可以使系统时钟为80MHz 的采 集系统达到320MHz 数据采集率(如图6 所示)。 3 总结 灵活地运用时钟分相技术, 可以有效地用低频时钟实现相当于高频时钟的时间性能, 并 避免了高速数字电路设计中一些问题, 降低了系统设计的难度。
上传时间： 2013-12-17
上传用户：xg262122
稳压电源的分类方法繁多，按输出电源的类型分有直流稳压电源和交流稳压电源；按稳压电路与负载的连接方式分有串联稳压电源和并联稳压电源；按调整管的工作状态分有线性稳压电源和开关稳压电源；按电路类型分有简单稳压电源和反馈型稳压电源，等等。如此繁多的分类方式往往让初学者摸不着头脑，不知道从哪里入手。其实应该说这些看似繁多的分类方法之间有着一定的层次关系，只要理清了这个层次自然可以分清楚电源的种类了。
标签： 稳压电源
上传时间： 2013-11-12
上传用户：dragonhaixm
一、实验目的 1. 学会选择变压器、整流二极管、滤波电容及集成稳 压 器来设计直流稳压电源。 2. 掌握直流稳压电源的主要性能参数及测试方法。 二、实验原理 电子设备一般都需要直流电源供电。这些直流电 除了少数直接利用干电池和直流发电机外，大多数是 采用把交流电（市电）转变为直流电的直流稳压电源。 直流稳压电源由电源变压器T、整流、滤波和稳压电路四部分组成，其原理框图如图1 所示。电网供给的交流电压u1(220V,50Hz) 经电源变压器降压后，得到符合电路需要的交流电压u2，然后由整流电路变换成方向不变、大小随时间变化的脉动电压u3，再用滤波器滤去其交流分量，就可得到比较平直的直流电压uI。但这样的直流输出电压，还会随交流电网电压的波动或负载的变动而变化。在对直流供电要求较高的场合，还需要使用稳压电路，以保证输出直流电压更加稳定。 1、串联型稳压电源的基本原理 图2是由分立元件组成的串联型稳压电源的电路图。其整流部分为单相桥式整流、电容滤波电路。稳压部分为串联型稳压电路，它由调整元件（晶体管V1）；比较放大器V2、R7；取样电路R1、R2、RP，基准电压VD、R3和过流保护电路V3管及电阻R4、R5、R6等组成。整个稳压电路是一个具有电压串联负反馈的闭环系统，其稳压过程为：当电网电压波动或负载变动引起输出直流电压发生变化时，取样电路取出输出电压的一部分送入比较放大器，并与基准电压进行比较，产生的误差信号经T2放大后送至调整管V1的基极，使调整管改变其管压降，以补偿输出电压的变化，从而达到稳定输出电压的目的。 2、集成稳压器 能够完成稳压功能的集成稳压器种类很多，根据调整管工作在线性放大区还是工作在开关状态，将其分为线性集成稳压器和开关集成稳压器。线性集成稳压器中，由于三端式稳压器只有三个引出端子，性能稳定、价格低廉等优点，因而得到广泛的应用。三端式稳压器有两种，一种输出电压是固定的，称为固定输出三端稳压器，另一种输出电压是可调的，称为可调三端稳压器。图 4是常用的三端稳压器示意图。
标签： 直流稳压电源
上传时间： 2013-11-27
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摘要:本文简要介绍了GWE-1型稳压电源的设计原理,已研制出样机,电势差计使用此电源比它用于电池要节约数千元.此电源值得推广应用.关键词:稳压电源;电流;电阻
上传时间： 2014-04-17
上传用户：star_in_rain
STM32，5110液晶显示声纳探鱼器200KHz，带电路图，精确到厘米 MC34063升压，大声压发射，实际板子上滤波电路没要（电路图上的滤波电阻电容电感没焊，开路或者短路）。一般200KHz的换能器在水里面的耦合比较好，在空气中发射出来的（或者接收的）强度很低。 用的MOSFET Relay，contact和release时间都可以做到很小，不过选的是比较低端器件，所以最近测量距离为70cm。 开源啦开源啦 架构为状态机+任务流，Task都是放在函数指针数组里面的 Task分两种，routine的和错误处理的 5110液晶的SPI用的DMA 基本上STM32和C语言高阶的特征都用上了，稍微修改直接可以商用 Open Issue 偶尔会hardware fault或者memory fault，然后watchdog重启， 应该比较好解决，仔细检查下就好 有什么问题代码的file comment里面有我联系地址 有能搞到好的器件也请知会我，多谢了 接下来准备把它装到船模上，用以前四轴的那套东西，就看什么时候有时间了
上传时间： 2013-10-28
上传用户：songyue1991
