代数系统

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（1） 实现小时（24进制）、分钟和秒钟（60进制）的计数功能。 （2） 功能功能扩展：具有复位、整点报时提示、定时闹钟等功能。

2025-01-03 10 代数系统

数字系统设计这是有关的相关源代码，有简易CPU 除法器、计数器等 ...[fpdiv_vhdl.rar] - 四位除法器的vhdl源程序 [vhdl范例.rar] - 最高优先级编码器8位相等比较器 三人表决器（三种不同的描述方式） 加法器...

2014-01-07 146 代数系统

摘要：介绍了一种利用CPLD芯片设计的数字钟电路，该系统采用自顶向下的层次模块化 设计手段构建电路，代表了BDA的发展趋势。文中结合实例详尽介绍了原理图设计输入方 式以及设计过程。    

2013-11-12 53 代数系统