七段译码

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本文使用Verilog 实现一个简单的3-8 译码器,并在硬件上验证,供FPGA 初学者参考。

2024-12-31 7 七段译码

此代码是线段树的实现源代码,可用O(nlogn)的时间查找出一段线段中任意一段的信息。做acm题很有用,应用程序中相信也能优化很多算法!

2013-12-17 37 七段译码