一位全加器
一位全加器，VERILOG实现，包括测试文件，测试可用，欢迎下载，共同学习...
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一位计数器
一位计数器，按p3.2数码管加1，到9后回0,同时小喇叭响一下报警码管数据p0,数码管控制p2口,按键p3.2口 ，喇叭p3.3...
输入一位脉冲信号
输入一位脉冲信号，输出八位的地址和数据信号。...
一位加法器
题目：一位加法器的设计 试实现一个十进制的1位数加法器，其中十进制数编码为8421码。十进制数加法可首先转换为二进制加法来执行。然后，若得到的和大于9，则产生一个进位值，并在得到的和值上加6(这是用来补足未使用的六种输入组合)。 要求：（1）利用基本逻辑门电路和编码器，译码器及计数器...
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