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VHDL 的代码
100vhdl+
--以下是部件声明的包
--部件mem_sequence,mem_string，以及协处理器分别在以下的包pkg_components中进行了说明
--每一个内存块中包括一个局部控制器，该局部控制器管理一个双向端口的RAM
--其中26-36行是mem_sequence的
--73-83行是mem_string的
--实际上每一个双端RAM都将其自己封装为真正的RAM部件
LIBR
100vhdl+
--LIBRARY synergy;
-- USE synergy.signed_arith.all;
LIBRARY ieee;
USE ieee.std_logic_1164.all;
USE ieee.std_logic_arith.all;
-- USE ieee.std_logic_signed.all;
-- USE synergy.signed_arit
100vhdl+
--这是子类型和部件声明的包
--用于区分向量类型的不同宽度
LIBRARY ieee;
USE ieee.std_logic_1164.ALL;
USE ieee.std_logic_arith.ALL;
PACKAGE pkg_types IS
SUBTYPE bit1 IS std_ulogic;
SUBTYPE bit
vhdl.vhd
-- generated by newgenasym Thu Apr 30 11:30:12 2009
library ieee;
use ieee.std_logic_1164.all;
use work.all;
entity \74ls256\ is
port (
A: IN STD_LOGIC_VECTOR (8 DOWNTO 0