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#-- Synplicity, Inc. #-- Version 6.2.4 #-- Project file mc8051_core.prj #-- Written on Fri Aug 24 19:26:03 2001 #add_file options add_file -vhdl -lib work "../vhdl/mc8051_p.vhd" add_file -vhdl -lib

-- ===== ============================= ===== -- ===== Compilation Script for xfft16 ===== -- ===== ============================= ===== -- vcom -87 -work work ./vhdl/radd16.vhd vcom -87 -work work

[Verilog.User Templates] type=folder [VHDL.User Templates] type=folder [ABEL.User Templates] type=folder

# ProjNav -> New -> Test Bench __projnav/createTB.err # ModelSim : Simulate Behavioral VHDL Model addsub_addsubtest_vhd_tb.fdo # ModelSim : Simulate Behavioral VHDL Model vsim.wlf # ModelSim : S

E:/new vhdl/vhdl10/db/Vhdl10.sim.vwf 2935 36931 774 36648 0 E:/new vhdl/vhdl10/Vhdl10.vwf 37000 83250 20 1000 0

E:/new vhdl/vhdl5/db/vhdl5.sim.vwf 0 73988 718 73988 4 E:/new vhdl/vhdl5/vhdl5.vwf 0 1000000 20 1000 0

E:/new vhdl/vhdl2/db/Vhdl2.sim.vwf 13136 78817 1071 65681 7 E:/new vhdl/vhdl2/Vhdl2.vwf 1325 93825 925 92500 0

E:/new vhdl/Vhdl1/db/Vhdl1.sim.vwf 0 27950 20 1000 0 E:/new vhdl/Vhdl1/Vhdl1.vwf 0 1000000 20 1000 0

请注意: 第94例是SPARC芯片的源描述,在本书的光盘中没有给出其源描述 代码,有关该描述的框架请参考. 如果您需要有关SPARC的详细资料以及完整代码,请与北京理工大学 ASIC研究所联系. 联系方法: 电话:010-68912434 信函:北京理工大学ASIC研究所 刘明业 教授收 邮编:100081

--**VHDL************************************************************* -- -- SRC-MODULE : PREFETCH -- NAME : prefetch.vhdl -- VERSION : 1.0 -- -- PURPOSE : Architecture of PREFETCH b