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VHDL 的代码
vhdl1.vhd
LIBRARY IEEE;
USE IEEE.STD_LOGIC_1164.ALL;
USE IEEE.STD_LOGIC_ARITH.ALL;
USE IEEE.STD_LOGIC_UNSIGNED.ALL;
ENTITY watch IS
PORT(clear:IN STD_LOGIC;
s1,m1:BUFFER STD_LOGIC_VECTOR(3 DOWN