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State Machine 的代码
state_m2.vhd
LIBRARY ieee;
USE ieee.std_logic_1164.all;
USE ieee.std_logic_unsigned.all;
USE ieee.std_logic_arith.all;
ENTITY state_m2 IS
PORT(clk, reset, nw : in std_logic;
sel: out std_logic_vector(1 down
state_s3.vhd
--在上面的例子中，系统的状态转移图是已知的，我们可以根据系统的
--状态转移图方便的写出VHDL代码。还有一种情况，系统的状态转移图
--是未知的，或者程序的状态转移图很复杂，不能够根据程序轻易的画
--出状态转移图，这时我们可以借助EDA软件来分析程序的状态转移图，
--假设含有状态转移图的VHDL代码如下：
LIBRARY ieee;
USE ieee.std_logic_1 ...
state_s3.qsf
# Copyright (C) 1991-2006 Altera Corporation
# Your use of Altera Corporation's design tools, logic functions
# and other software and tools, and its AMPP partner logic
# functions, and any outpu
state_s3.done
Sun Feb 18 13:13:09 2007