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PCB 的代码
signoise.log,3
INFO: Loaded existing Interconnect file 'F:/wenjian/第十一章/自动布线/interconn.iml'
INFO: Loaded existing Interconnect file 'D:/Cadence/SPB_16.2/share/pcb/signal/cds_interconn.iml'
INFO: Finished loading S
3addrmnasgn.scr
# Allegro script
# file: D:\Develop\PSD140\140AllegroFoundation\Capture\PSDTraining\project2\allegro_brd\3addrmnasgn.scr
# start time: Tue Jun 05 11:20:10 2001
version 14.0
setwindow pcb
open
8rename.scr
# Allegro script
# file: D:\Develop\PSD140\140AllegroFoundation\Capture\Allegro\8rename.scr
# start time: Wed Apr 18 14:06:39 2001
version 14.0
setwindow pcb
open
fillin "shape.brd"
zoom f
6glos.scr
# Allegro script
# file: D:\Develop\PSD140\140AllegroFoundation\Capture\Allegro\6glos.scr
# start time: Mon Apr 16 14:54:17 2001
version 14.0
setwindow pcb
open
fillin "routed.brd"
gloss p
5gtrdy2rt.scr
# Allegro script
# file: D:\Develop\PSD140\140AllegroFoundation\Capture\Allegro\gtrdy2rt.scr
# start time: Thu Apr 05 10:58:16 2001
version 14.0
setwindow pcb
open
fillin "placed.brd"
defi
module1.bas
Attribute VB_Name = "Module1"
Public Type PCB
PName As String '进程名称
PCPUTime As Integer '已使用的时间片数
PNeedCPU As Integer '需要的时间片数
PPRI As Integer '优先数(优先数法)
PSubTime As
flsh_q_1.c
// FLSH_Q.C (PIC16HV540), CCS PCB
//
// When input PORTB7 is at ground, T_threshold is output to LED on PORTA0.
// When input PORTB7 is not at ground, the current value of T_C is output on
// the
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