代码搜索：时钟提取
找到约 10,000 项符合「时钟提取」的源代码
代码结果 10,000
www.eeworm.com/read/17631/747973
vhd div5_1.vhd
library ieee;
use ieee.std_logic_1164.all;
use ieee.std_logic_unsigned.all;
entity div5_1 is
port(clk:in std_logic;-------时钟
div5:buffer std_logic);----输出5分频信号
end;
architecture one of div
www.eeworm.com/read/17631/748641
vhd div5.vhd
library ieee;
use ieee.std_logic_1164.all;
use ieee.std_logic_unsigned.all;
entity div5 is
generic(n:integer:=5);
port(clk:in std_logic;-------时钟
div5:out std_logic);----输出5分频信号
end;
arch
www.eeworm.com/read/17631/748697
vhd div_half.vhd
library ieee;
use ieee.std_logic_1164.all;
use ieee.std_logic_unsigned.all;
entity div_half is
generic(n:integer:=2);--------n为分频系数的整数部分+1
port(clk:in std_logic;--------时钟信号
div:out std_lo
www.eeworm.com/read/17631/748758
vhd div6.vhd
library ieee;
use ieee.std_logic_1164.all;
use ieee.std_logic_unsigned.all;
entity div6 is
port(clk:in std_logic;--------时钟
div6:out std_logic);----输出6分频信号
end;
architecture one of div6 is
www.eeworm.com/read/17631/750045
vhd div7.vhd
library ieee;
use ieee.std_logic_1164.all;
use ieee.std_logic_unsigned.all;
entity div7 is
port(clk:in std_logic;--------时钟
div7:out std_logic);----输出7分频信号
end;
architecture one of div7 is
www.eeworm.com/read/17631/750360
vhd div12.vhd
library ieee;
use ieee.std_logic_1164.all;
use ieee.std_logic_unsigned.all;
entity div12 is
port(clk:in std_logic;--------时钟
div12:out std_logic);----输出12分频信号
end;
architecture one of div1
www.eeworm.com/read/21470/837689
landzo
/******************** (C) COPYRIGHT 2011 野火嵌入式开发工作室\蓝宙电子工作室 ********************
* 文件名 ：mcg.c
* 描述 ：工作时钟模式设置，锁相环。
* 备注 ：官方例程上修改
*
* 实验平台 ：野火kinetis开发板
* 库版本
www.eeworm.com/read/26592/853696
1
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;; GPS时钟系统 ;;
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;
;用W78E516B单片机
;本程序接收GPS的$GPGGA信息中的时间数据，采用12MHZ晶振，4800波特率接收
;使用资源：R0、R1
www.eeworm.com/read/26592/853700
1
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;; GPS时钟系统 ;;
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;用W78E516B单片机
;本程序接收GPS的$GPGGA信息中的时间数据，采用12MHZ晶振，4800波特率接收
;使用资源：R0、R1
www.eeworm.com/read/26592/853702
1
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;; GPS时钟系统 ;;
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;用W78E516B单片机
;本程序接收GPS的$GPGGA信息中的时间数据，采用12MHZ晶振，4800波特率接收
;使用资源：R0、R1