代码搜索:多总线测试

找到约 10,000 项符合「多总线测试」的源代码

代码结果 10,000
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txt iotest程序说明.txt

程序说明 1、程序对LED灯进行测试, xf 对应 L1 低电平亮, GPIO7对应L2 低电平亮 2、可以对SDRAM进行测试 96Mhz CLKMEM GPIO4 control SDRAM CKE SDRAM 测试时, L1 L2 L3 长亮, 在测试完成后,L1 闪亮, L2/L3同步闪亮, 如果中间同时出现3个LED 灯不亮,则表示SDRAM有问
www.eeworm.com/read/337884/12334509

c iwire.c

/************************************************************* ****************1wire总线操作函数***************************** *************************************************************/ //extern int8
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bak iwire.bak

/************************************************************* ****************1wire总线操作函数***************************** *************************************************************/ #define IB_RD
www.eeworm.com/read/160854/10482888

htm 接口类型与特性.htm

vti_encoding:SR|utf8-nl vti_timelastmodified:TR|24 Aug 2000 05:38:21 -0000 vti_extenderversion:SR|4.0.2.3406 vti_backlinkinfo:VX|网页工程/io性能测试.htm 网页工程/第八章.htm 网页工程/buses总线.htm vti_filesize:IR|20903 vti
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inc zlg7289all.inc

;本程序ZLG7289的测试程序,可以测试ZLG7289的所有功能. ;******特殊寄存器定义,定义P87LPC76X特有的特殊功能寄存器*********************** AUXR1 DATA 0A2H CMP1 DATA 0ACH CMP2 DATA 0ADH DIVM DATA 095H ;I2C 总线寄存器定义 I2CFG DATA 0
www.eeworm.com/read/227039/14443519

asm zlg7289all.asm

;本程序ZLG7289的测试程序,可以测试ZLG7289的所有功能. ;******特殊寄存器定义,定义P87LPC76X特有的特殊功能寄存器*********************** AUXR1 DATA 0A2H CMP1 DATA 0ACH CMP2 DATA 0ADH DIVM DATA 095H ;I2C 总线寄存器定义 I2CFG DATA 0
www.eeworm.com/read/205973/15302810

asm zlg7289all.asm

;本程序ZLG7289的测试程序,可以测试ZLG7289的所有功能. ;******特殊寄存器定义,定义P87LPC76X特有的特殊功能寄存器*********************** AUXR1 DATA 0A2H CMP1 DATA 0ACH CMP2 DATA 0ADH DIVM DATA 095H ;I2C 总线寄存器定义 I2CFG DATA 0
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txt 说明.txt

本系统采用Struts+Hibernate+Spring三个框架和MYSQL数据库,使用Eclipse+mymclipse进行编写 一共14张表 包括了多对多双向、一对多双向、一对多单向、多对一单向、一对一双向等关系 使用了Tiles作为jsp的框架 系统默认管理员帐号 admin/admin 教师帐号 teacher/teacher
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uv2 24c02.uv2

### uVision2 Project, (C) Keil Software ### Do not modify ! Target (Target 1), 0x0000 // Tools: 'MCS-51' Group (Source Group 1) File 1,1, 0x0 Optio
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c ds18b20.c

//包含所需头文件 #include "Com_header.h" #define CLR_DIR_1WIRE DDRD&=~BIT(7) // 设置总线为输出口 #define SET_DIR_1WIRE DDRD|=BIT(7) // 设置总线为输入口 #define CLR_OP_1WIRE PORTD&=~BIT(7) // 总线清0