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xilinx 的查询结果
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技术资料 ispLEVER2
ispLEVER2.0是一套完整的EDA软件。设计输入可采用原理图、硬件描述语言、混合输入三种方式。能对所设计的数字电子系统进行功能仿真和时序仿真。编译器是此软件的核心，能进行逻辑优化，将逻辑映射到器件中去，自动完成布局与布线并生成编程所需要的熔丝图件。软件支持原有Lattice公司的GAL、ispLSI、MACH、ispGDX、ORCA2、O ...
技术资料 级联码及FPGA实现算法的研究
本论文讨论的就是基于Xilinx的ViterxII系列芯片，IEEE802.16a协议物理层纠错编码实现算法的研究。 概述了无线城域网的发展和应用，接着对信道编码的作用和发展以及FPGA的特点和应用作了概述，同时介绍了作者所做的主要工作。介绍IEEE802.16协议族。然后具体到IEEE80216a协议，对其MAC层，物理层，做了详细的介绍。 ...
精品软件 ISPLEVER2
ispLEVER2.0是一套完整的EDA软件。设计输入可采用原理图、硬件描述语言、混合输入三种方式。能对所设计的数字电子系统进行功能仿真和时序仿真。编译器是此软件的核心，能进行逻辑优化，将逻辑映射到器件中去，自动完成布局与布线并生成编程所需要的熔丝图件。软件支持原有Lattice公司的GAL、ispLSI、MACH、ispGDX、ORCA2、O ...
技术资料 MTDSCDMA中频收发信机设计与FPGA实现.rar
随着OFDM和CDMA技术的发展，在移动通信系统中运用两者相结合的多载波CDMA成为趋势。基于MT-DS-CDMA系统的中频收发信机中，数字滤波和数字调制/解调是重要的组成部分，不仅信号与信息处理的重要分支，也是数字化的基本的功能。由于FPGA的特点，运用FPGA芯片进行实现数字信号处理部分已经成为最佳途径。 @@ 本文首先阐述了数 ...
技术资料 FPGA在超级服务器中的应用研究
超级服务器(也叫刀片服务器)的研究和设计实现了大量数据存储和高性能计算的需求,它应用ISCSI协议,通过TCP/IP实现网络存储.该文重点放在超级服务器中刀片的方案设计上,通过使用Xilinx的FPGA(Field Programmable Gate Array)芯片,来实现PCI桥(Intel 21154 PCI bridge)与Flash的数据传输,主要是根据PCI2.3协议实现PCI芯片内核, ...
技术资料 如何在zynq上挂linux
在这个网页上，ZC702开发板上挂linux并且通过HDMI接口显示图形甚至linux图形界面，而且能接鼠标键盘正常操作，甚至上网，跟一台电脑一样没区别，都可以在xilinx的zynq开发板上实现。并且不止ZC702，同是xilinx开发板的ZC706和学生的最爱zedboard也一样可以实现挂linux并且通过HDMI口实现图像输出图形界面。不过话说在前面， ...
教程资料 XAPP520将符合2.5V和3.3V I/O标准的7系列FPGA高性能I/O Bank进行连接
XAPP520将符合2.5V和3.3V I/O标准的7系列FPGA高性能I/O Bank进行连接 
The I/Os in Xilinx® 7 series FPGAs are classified as either high range (HR) or high performance (HP) banks. HR I/O banks can be operated from 1.2V to 3.3V, whereas HP I/O banks are optimized for operation between 1.2V and ...
通信网络 LTE系统中RRC连接建立过程的设计
为了实现LTE系统中RRC连接建立的需求，提出了一种对RRC层连接过程进行设计的方案，并完成系统的软件设计。该系统将RRC层的空闲状态和连接状态均细分为两个子状态，有效降低了系统设计的复杂度。软件采用Xilinx SDK工具集进行开发，通过在PC上分别模拟终端和基站进行测试，终端和基站能够成功接收到正确的RRC消息。实验结果 ...
嵌入式综合 一种片上系统复位电路的设计
设计了一种片上系统（SoC）复位电路。该电路能对外部输入信号进行同步化处理以抑制亚稳态，采用多级D触发器进行滤波提升抗干扰能力，并且控制产生系统所需的复位时序以满足软硬件协同设计需求。同时，完成了可测性设计（DFT）。基于Xilinx spartan-6 FPGA进行了验证。结果表明该电路可以抑制90 ?滋s以下的外部干扰信号，并 ...
可编程逻辑 XAPP520将符合2.5V和3.3V I/O标准的7系列FPGA高性能I/O Bank进行连接
XAPP520将符合2.5V和3.3V I/O标准的7系列FPGA高性能I/O Bank进行连接 
The I/Os in Xilinx® 7 series FPGAs are classified as either high range (HR) or high performance (HP) banks. HR I/O banks can be operated from 1.2V to 3.3V, whereas HP I/O banks are optimized for operation between 1.2V and ...