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技术资料 空间对接装置通用算法的FPGA实现

本文简述空间对接的基本概念,对空间对接装置中的通用算法,包括预处理、自动门限和隔点差分的FPGA 实现进行了详尽的分析,对VHDL 与Verilog HDL 两种硬件描述语言的区别加以
https://www.eeworm.com/dl/930103.html
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技术资料 Altera Quartus II 电路图设计教程英文原版

本资料适合英语能力强的专业电子工程师,本资料介绍使用Altera公司的开发工具Quartus II 进行基本电路图开发的过程,其中包括基本电路图的设计,波形向量函数的生成,verilog代码的编辑和验证,以及FPGA对应引脚的分配。
https://www.eeworm.com/dl/859703.html
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技术资料 FPGA串口通信

FPGA实现RS-232串口收发的仿真过程(Quartus+Synplify+ModelSim)(2007-09-11 12:17:37) 结合FPGA的开发流程,主要走了以下几步: 1. 文本程序输入(Verilog HDL) 2. 功能仿真(ModelSim,查看逻辑功能是否正确,要写一个Test Bench)
https://www.eeworm.com/dl/980452.html
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技术资料 FPGA数码管动态显示

掌握FPGA数码管动态显示的精髓,这份Verilog代码经过多个项目实战验证,可直接应用于生产环境。支持1到9的数字显示,适用于各种嵌入式系统和硬件开发需求,是提升项目稳定性和性能的理想选择。
https://www.eeworm.com/dl/995447.html
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学术论文 适用于H.264视频解码器的VLD设计

设计了一种适合于H.264 的变字长解码器根据码流特点进行模块划分减少硬件开销采用并行结构解NAL 包解码效率高采用了桶形移位器进行并行解码每个时钟解一个码字采用Verilog 语言进行设计仿真并通过
https://www.eeworm.com/dl/514/9826.html
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其他 文通过ALTERA公司的quartus II软件

文通过ALTERA公司的quartus II软件,用Verilog HDL语言完成多功能数字钟的设计。主要完成的功能为:计时功能,24小时制计时显示;通过七段数码管动态显示时间;校时设置功能,可分别设置时、分、秒;跑表的启动、停止 、保持显示和清除。 ...
https://www.eeworm.com/dl/534/388528.html
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教程 FPGA使用

第一讲:Quartus II 安装及工程建立。 第二讲:Verilog HDL语言的运用及仿真。 第三讲:原理图方式编程及IP核调用。 第四讲:程序下载。
https://www.eeworm.com/dl/513318.html
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技术资料 《阿东 手把手教你学FPGA》完美公开版

本书主要讲解FPGA的程序设计,以一款热销的FPGA开发板为例,介绍学习FPGA和使用Verilog,以及FPGA开发板的硬件配置,重点是第3章的16个典型实例程序,由简单到复杂,最后是FPGA的设计心得。
https://www.eeworm.com/dl/849154.html
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技术资料 适用于H.264视频解码器的VLD设计

设计了一种适合于H.264 的变字长解码器根据码流特点进行模块划分减少硬件开销采用并行结构解NAL 包解码效率高采用了桶形移位器进行并行解码每个时钟解一个码字采用Verilog 语言进行设计仿真并通过
https://www.eeworm.com/dl/901034.html
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技术资料 Master statemachine

直接适用于生产环境的Verilog状态机代码,经过多个项目验证与优化,确保稳定性和高效性。无论是在复杂系统控制还是在数据处理中,都能提供可靠的解决方案。适合需要高质量、可维护状态机设计的工程师。
https://www.eeworm.com/dl/995982.html
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