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VHDL/FPGA/Verilog 1.高精度数字秒表（0.01秒的vhdl语言实现） 2.具有定时

1.高精度数字秒表（0.01秒的vhdl语言实现） 2.具有定时，暂停，按键随机存储，翻页回放功能； 3.对30M时钟分频产生显示扫描时钟 4.精度高达0.01s,并且可以通过改变主频来更改分频比和记数间隔，可控性高。 5.模块化设计，其中的许多函数可以成为vhdl语言的通用经典例子（包含分频电路设计，动态扫描时钟设计，译码电路设计 ...

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单片机开发  1.AD0809转换器的vhdl实现 2.用状态机来实现不同状态的动态切换

1.AD0809转换器的vhdl实现 2.用状态机来实现不同状态的动态切换，思路明晰简单实现。 3.内含注释，易于修改和理解 4.对数码管的动态扫描,显示

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嵌入式/单片机编程  1.汉明编码的硬件实现vhdl语言 2.测试用

1.汉明编码的硬件实现vhdl语言 2.测试用，简单明晰 3.内含有另一份c代码的汉明码纠错编码源代码

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软件设计/软件工程  项目中自己设计的URAT的VHDL源程序及仿真

项目中自己设计的URAT的VHDL源程序及仿真，已经通过了编译和仿真，有项目用的到的可参考下。

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VHDL/FPGA/Verilog 基本FIR滤波器的VHDL源代码及其测试程序。

基本FIR滤波器的VHDL源代码及其测试程序。

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VHDL/FPGA/Verilog SPI协议的VHDL/Verilog语言实现。

SPI协议的VHDL/Verilog语言实现。

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并行计算  通过CPLD实现串行通信之VHDL语言

通过CPLD实现串行通信之VHDL语言，好看易懂

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文件格式  用VHDL能进行正常的时、分、秒计时功能、分别有6个数码管显示24小时、60分钟、60秒钟的计数器显示。

用VHDL能进行正常的时、分、秒计时功能、分别有6个数码管显示24小时、60分钟、60秒钟的计数器显示。

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VHDL/FPGA/Verilog 非整数分频器分频系数为无限不循环小数 vhdl

非整数分频器分频系数为无限不循环小数 vhdl

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VHDL/FPGA/Verilog 基于VHDL的串行异步通信电路的设计包括串行发送器

基于VHDL的串行异步通信电路的设计包括串行发送器，异步接收器，以及控制器 vhdl

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