搜索结果
找到约 432 项符合
mAx 的查询结果
按分类筛选
- 全部分类
- VHDL/FPGA/Verilog (83)
- 其他 (40)
- 技术书籍 (22)
- 技术资料 (19)
- 学术论文 (16)
- 其他书籍 (15)
- 单片机开发 (13)
- 教程资料 (11)
- 系统设计方案 (11)
- MAX+plusⅡ (9)
- 可编程逻辑 (9)
- 数学计算 (9)
- 电子书籍 (8)
- 电子书籍 (8)
- 源码 (8)
- FPGA (7)
- 单片机编程 (7)
- 数据结构 (7)
- 电源技术 (6)
- 文章/文档 (6)
- 编译器/解释器 (6)
- 汇编语言 (6)
- 人工智能/神经网络 (6)
- matlab例程 (6)
- 教程资料 (4)
- Java编程 (4)
- 书籍 (4)
- VIP专区 (4)
- 设计相关 (3)
- DSP编程 (3)
- 开发工具 (3)
- 操作系统开发 (3)
- 嵌入式/单片机编程 (3)
- ALTERA FPGA开发软件 (2)
- Linux/Unix编程 (2)
- 加密解密 (2)
- *行业应用 (2)
- 文件格式 (2)
- 书籍源码 (2)
- 数值算法/人工智能 (2)
- Java书籍 (2)
- 软件设计/软件工程 (2)
- Delphi控件源码 (2)
- 其他行业 (2)
- 接口技术 (2)
- 技术教程 (2)
- 手册 (2)
- 教程 (2)
- 软件 (2)
- 精品软件 (2)
- EDA (1)
- EDA相关 (1)
- 行业应用文档 (1)
- 资料/手册 (1)
- 模拟电子 (1)
- Proe教程 (1)
- autocad教程 (1)
- 通信网络 (1)
- 传感与控制 (1)
- PCB相关 (1)
- Internet/网络编程 (1)
- 酒店行业 (1)
- 生物技术 (1)
- 中间件编程 (1)
- 传真(Fax)编程 (1)
- 技术管理 (1)
- 通讯编程文档 (1)
- 串口编程 (1)
- 其他嵌入式/单片机内容 (1)
- 金融证券系统 (1)
- 行业发展研究 (1)
- 并行计算 (1)
- VC书籍 (1)
- SQL Server (1)
- 家庭/个人应用 (1)
- 通讯/手机编程 (1)
- PCB图/BOM单/原理图 (1)
- Linux/uClinux/Unix编程 (1)
- 应用设计 (1)
Linux/Unix编程 VLSi KL partitioning Algorithm based programme for 100 nodes. It s dynamic progremme so by changing
VLSi KL partitioning Algorithm based programme for 100 nodes.
It s dynamic progremme so by changing the MAX value we can change the number of nodes in the network.
电子书籍 一篇关于7128CPLD的英文介绍
一篇关于7128CPLD的英文介绍，里面包含了44脚到100引脚各个型号的MAX系列cpld
VHDL/FPGA/Verilog 数字频率计是一种用来测试周期性变化信号工作频率的装置。其原理是在规定的单位时间（闸门时间）内
数字频率计是一种用来测试周期性变化信号工作频率的装置。其原理是在规定的单位时间（闸门时间）内，记录输入的脉冲的个数。我们可以通过改变记录脉冲的闸门时间来切换测频量程。本文利用EDA技术中的Max+plusⅡ作为开发工具,设计了基于FPGA的8位十进制频率计,并下载到在系统可编程实验板的EPF10K20TC144-4器件中测试实现了 ...
编译器/解释器 生成Trick文件工具 1.Open command line 2.input tricktest Usage: TrickTest -f -o -i -f source mpeg2 fil
生成Trick文件工具
1.Open command line
2.input tricktest
Usage: TrickTest -f -o -i
-f source mpeg2 file to trick
-o trick output directory
-i output file id
-m max coding error, default 0
-b max bitrate for trick generate, default 0 mean no limit
-s trick buffer block size, must be n*188
-l lo ...
VHDL/FPGA/Verilog 系统介绍EDA技术的发展概述
系统介绍EDA技术的发展概述，相关概念，VHDL语言、MAX+PULS、QUARTUS的设计方法。
人工智能/神经网络 This routine calls the glpk library to solve a LP/MIP problem. A typical LP problem has following s
This routine calls the glpk library to solve a LP/MIP problem. A typical
LP problem has following structure:
[min|max] C x
s.t.
Ax ["="|"<="|">="] b
{x <= UB}
{x >= LB}
The calling syntax is:
[XMIN,FMIN,STATUS,EXTRA]= ...
数据结构 三： 针对带表头结点的单链表
三： 针对带表头结点的单链表，试编写下列函数。
(1) 定位函数Locate：在单链表中寻找第i个结点。若找到，则函数返回第i个结点的地址；若找不到，则函数返回NULL。
(2) 求最大值函数max：通过一趟遍历在单链表中确定值最大的结点。
(3) 统计函数number：统计单链表中具有给定值x的所有元素。
(4) 建立函数create：根据一维 ...
VHDL/FPGA/Verilog 文中介绍了QPSK调制解调的原理
文中介绍了QPSK调制解调的原理，并基于FPGA实现了QPSK调制解调电路。MAX+PLUSII环境下的仿真结果表明了该设计的正确性。
VHDL/FPGA/Verilog 秒信号发生器
秒信号发生器，供初学者了解vhdl的编程方法，程序非常简单。编程环境使用Max+Plus IIV10.12
系统设计方案 使用VHDL语言编写的简易数字存储示波器
使用VHDL语言编写的简易数字存储示波器，用MAX+PlusII仿真验证。VHDL编写了采样、存储写、存储读和显示4个模块。采样使用ADC0809，存储器使用6264，显示使用DAC0832。