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VHDL/FPGA/Verilog 实现简单CPU功能的源码

实现简单CPU功能的源码，可以实现加减乘除和移位功能，VHDL代码，程序运行在MAX PULS和Quartua上。

https://www.eeworm.com/dl/663/478864.html

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数据结构  赋权有向图中心问题问题描述: 设G=(V,E)是一个赋权有向图

赋权有向图中心问题问题描述: 设G=(V,E)是一个赋权有向图，v是G的一个顶点， v的偏心距定义为： Max {w∈ V,从w到v的最短路径长度} G中偏心距最小的顶点称为G的中心。试利用Floyd 算法设计一个求赋权有向图中心的算法。 ...

https://www.eeworm.com/dl/654/479229.html

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VHDL/FPGA/Verilog 该系统利用VHDL语言、PLD设计出租车计费系统

该系统利用VHDL语言、PLD设计出租车计费系统，以MAX+PLUSⅡ软件作为开发平台，设计了出租车计费器系统程序并进行了程序仿真。使其实现计费以及预置和模拟汽车启动、停止、暂停等功能，并动态扫描显示车费数目。

https://www.eeworm.com/dl/663/483508.html

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操作系统开发  A badic controller for the UART. It incorporates a -- transmit and receive FIFO (fr

A badic controller for the UART. It incorporates a -- transmit and receive FIFO (from Max+Plus II s MegaWizard -- plug-in manager). Note that no checking is done to see -- whether the FIFOs are overflowing or not. This strictly -- handle ...

https://www.eeworm.com/dl/531/486351.html

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VHDL/FPGA/Verilog 一个用VHDL编写的秒表程序

一个用VHDL编写的秒表程序，可用Max+PlusII仿真

https://www.eeworm.com/dl/663/486908.html

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VHDL/FPGA/Verilog 内容摘要：在简单介绍算术编码和自适应算术编码的基础上

内容摘要：在简单介绍算术编码和自适应算术编码的基础上，介绍了利用FPGA器件并通过VHDL语言描述实现自适应算术编码的过程。整个编码系统在LTERA公司的MAX+plus Ⅱ软件上进行了编译仿真，测试结果表明：编码器各个模块的设计在速度和资源利用两方面均达到了较优的状态，可以满足实时编码的要求。 ...

https://www.eeworm.com/dl/663/488928.html

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设计相关  补码运算器

使用Altera的MAX+PlusII设计了一个补码运算器，文档里包含了详细的设计原理及完整电路

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Linux/uClinux/Unix编程  ELF文件查看

elf &nbsp;文件格式分析各种讲解 elf 文件格式一上来就是各种数据类型，看了半天却不知道这些数据类型是干啥的，所以咱就先找个例子直接上手，这样对 elf 文件格式有个具体而生动的了解。然后再去看那些手册，就完全不惧了～。我们使用一个汇编程序 max.s 并对其进行编译链接产生的两个 elf 文件来对比分析 elf 文件。 ...

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接口技术  net_tcp.h

/* ********************************************************************************************************* * &nbsp; &nbsp; &nbsp; &nbsp; &nbsp; &nbsp; &nbsp; &nbsp; &nbsp; &nbsp; &nbsp; &nbsp; &nbsp; &nbsp; &nbsp; &nbsp; &nbsp; &nbsp; &nbsp; &nbsp; &nbsp; &nbsp; uC/TCP-IP V2 * &nbsp; &nbsp; &nbsp; ...

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接口技术  max5 MAX V Device Handbook

关于CPLD的资料关于CPLD的资料关于CPLD的资料关于CPLD的资料关于CPLD的资料关于CPLD的资料关于CPLD的资料关于CPLD的资料

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