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ip核 的查询结果
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教程资料 基于SDR Sdram(同步动态RAM) 作为主存储器的LED 显示系统的研究
针对主控制板上存储器(SRAM) 存储的数据量小和最高频率低的情况,提出了基于SDR Sdram(同步动态RAM) 作为主存储器的LED 显示系统的研究。在实验中,使用了现场可编程门阵列( FPGA) 来实现各模块的逻辑功能。最终实现了对L ED 显示屏的控制,并且一块主控制板最大限度的控制了256 ×128 个像素点,基于相同条件,比静态内存控制的 ...
单片机编程 基于单片机的上网计时系统的设计
本文设计了一个用AT89S51 实现手动控制的上网计时系统，这套系统由单片机作为核心部件，只需在pc 机上网和断网时按下计时开关，计时器系统即开始自动计时，并可以累计本月上网总时长，还可以同时显示本次上网时长和累计上网时长。此外，本系统还可以设定上网报警时间，当超出设定值时，系统会发出报警提示。通过单片机的自 ...
嵌入式综合 基于NiosⅡ的UART设计与实现
设计了一种基于NiosⅡ的UART系统，采用软硬件协作设计的思想调用了UART核并通过编译相关软件驱动的方式实现RS232协议的通信。首先介绍了UART的协议原理，然后描述了基本的硬件构造和软件编程方法。编译仿真无误后下载到芯片通过串口调试软件进行了调试验证。
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嵌入式综合 面向丰富实时应用的Vybrid控制器解决方案，第1部分：简介
Vybrid控制器解决方案为市场提供低功耗异构架构，使客户能够将需要高分辨率图形显示与连接的丰富应用与实时决策机制结合在一起。这个系列的产品组合广泛，从需要大规模片上SRAM客户所需的入门级单核设备到高集成异构双核设备均包括在内，这些产品可同时服务于工业及个人消费市场 。
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软件设计/软件工程 针对主控制板上存储器(SRAM) 存储的数据量小和最高频率低的情况,提出了基于SDR Sdram(同步动态RAM) 作为主存储器的LED 显示系统的研究。在实验中,使用了现场可编程门阵列( FPGA)
针对主控制板上存储器(SRAM) 存储的数据量小和最高频率低的情况,提出了基于SDR Sdram(同步动态RAM) 作为主存储器的LED 显示系统的研究。在实验中,使用了现场可编程门阵列( FPGA) 来实现各模块的逻辑功能。最终实现了对L ED 显示屏的控制,并且一块主控制板最大限度的控制了256 ×128 个像素点,基于相同条件,比静态内存控制的 ...
数学计算 kernel-ica
ica 核独立主元分析（kernel independent component analysis)软件工具包
技术资料 FU6831产品数据手册
FU6831 是一款集成 8051 内核和电机控制引擎(ME)的电机驱动专用芯片，8051 内核处理常规事务，ME 处理电机实时事务，双核协同工作实现各种高性能电机控制。其中 8051 内核大部分指令周期为 1T 或 2T，芯片内部集成有高速运算放大器、比较器、Pre-driver、高速 ADC、高速乘/除法器、CRC、SPI、I2C、UART、多种 TIMER、PWM 等 ...
技术资料 SC51P0304说明书_1.6
SC51P0304是一款3V的I/O型低功耗8位MCU。它采用SC51核，内嵌4K字节OTP和128字节RAM。1.8V~3.6V的工作电压范围、超低停机电流和低频下低工作电流等特点，使其特别适合电池供电应用系统。4K程序容量、优化的抗干扰性能、8mA管脚驱动能力、丰富的定时器功能和相当于8位PWM的载波发生器，也使SC51P0304适合于各种小家电控制应用 ...
技术资料 一种利用FPGA的CPU设计
基于现场可编程(FPGA)技术和硬件描述语言VHDL的设计和综合，通过自顶向下的设计方法和模块化设计思想，在Quartus II环境下能定制、仿真、下载验证和实现CPU功能。通过VHDL语言定制了运算器ALU模块和调用宏模块定制了RAM模块，介绍了基于FPGA的CPU设计方法，并通过初始化程序进行验证，实现了基于FPGA的CPU功能，表明基于FPG ...
技术资料 提升管内气固流动的小波分析
·摘 要:对由光纤探头获得的提升管循环流化床内颗粒体积分数的瞬态信号，采用Dauchveies小波（db4）进行15层的小波分解，并计算各尺度能量分率，以研究提升管底部浓相段与顶部稀相段气固流动结构。结果表明：颗粒速度、体积分数、能量分率在径向分布都呈典型的环核结构；底部浓相段和顶部稀相段的高、中、低频能量分率基本 ...