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VHDL/FPGA/Verilog 福州大学EDA实验代码,其中包含电子琴,DA转换器,时钟显示器等

福州大学EDA实验代码,其中包含电子琴,DA转换器,时钟显示器等

https://www.eeworm.com/dl/663/313622.html

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VHDL/FPGA/Verilog 用VHDL语言编写的8255,它通过EDA平台可代替8255来使用.

用VHDL语言编写的8255,它通过EDA平台可代替8255来使用.

https://www.eeworm.com/dl/663/317985.html

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电子书籍  GW48 EDA系统使用说明 GW48教学实验系统原理与使用介绍 GW48系统使用注意事项

GW48 EDA系统使用说明 GW48教学实验系统原理与使用介绍 GW48系统使用注意事项

https://www.eeworm.com/dl/cadence/ebook/319314.html

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VHDL/FPGA/Verilog 基于北京革新公司出品的EDA实验工具箱的键盘扫描与同步显示程序。编译环境为quartusll.5.1版本。fpga芯片为EP18CQ240C6

基于北京革新公司出品的EDA实验工具箱的键盘扫描与同步显示程序。编译环境为quartusll.5.1版本。fpga芯片为EP18CQ240C6

https://www.eeworm.com/dl/663/319960.html

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VHDL/FPGA/Verilog 基于北京革新公司出品的EDA实验工具箱的LED扫描显示程序。能够显示8位数字。编译环境为quartusll.5.1版本。fpga芯片为EP18CQ240C6

基于北京革新公司出品的EDA实验工具箱的LED扫描显示程序。能够显示8位数字。编译环境为quartusll.5.1版本。fpga芯片为EP18CQ240C6

https://www.eeworm.com/dl/663/319963.html

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VHDL/FPGA/Verilog 基于北京革新公司出品的EDA实验工具箱的数模转换程序。该程序将输入的5V信号从01至FF量化并通过2位数码管进行显示。量化精度为0.1v。编译环境为quartusll.5.1版本。fpga芯片为EP1

基于北京革新公司出品的EDA实验工具箱的数模转换程序。该程序将输入的5V信号从01至FF量化并通过2位数码管进行显示。量化精度为0.1v。编译环境为quartusll.5.1版本。fpga芯片为EP18CQ240C6

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VHDL/FPGA/Verilog EDA实验--PS2键盘实验:利用键盘作为输入设备

EDA实验--PS2键盘实验:利用键盘作为输入设备，显示器作为输出设备，FPGA将键盘输入的数字键的编码进行编码，然后在显示器上显示。

https://www.eeworm.com/dl/663/320680.html

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嵌入式/单片机编程  EDA实验--RAM实验:利用-MegaWizard Plug-In Manager创建一个16×8的RAM

EDA实验--RAM实验:利用-MegaWizard Plug-In Manager创建一个16×8的RAM，通过编程对RAM进行读写并在显示器上显示。本例使用三个按键PSW3，PSW2，PSW1，分别对应顶层文件中的x，y，we，we＝1对RAM写，xy＝11时，写入10101011；当xy＝01时，写入01010101；当xy＝10时，写入10101010。we＝0时，对RAM读出。三个按键按下时为0 ...

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嵌入式/单片机编程  EDA实验--ROM实验:利用-MegaWizard Plug-In Manager创建一个256×16的ROM

EDA实验--ROM实验:利用-MegaWizard Plug-In Manager创建一个256×16的ROM，并对ROM进行初始化。本实验中ROM初始化为2550－0，256个数依次递减10，PSW1为CLKEN，按下停止读出数据。通过编程读出ROM中的内容并在显示器上显示。

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VHDL/FPGA/Verilog EDA实验--UART串口实验：UART 主要有由数据总线接口、控制逻辑、波特率发生器、发送部分和接收部分等组成。UART 发送器 --- 发送器每隔16 个CLK16 时钟周期输出1 位

EDA实验--UART串口实验：UART 主要有由数据总线接口、控制逻辑、波特率发生器、发送部分和接收部分等组成。UART 发送器 --- 发送器每隔16 个CLK16 时钟周期输出1 位，次序遵循1位起始位、8位数据位（假定数据位为8位）、1位校验位（可选）、1位停止位。 UART 接收器 --- 串行数据帧和接收时钟是异步的，发送来的数据由逻 ...

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